7
1.3
Pin Description
1.3.1
Pin Assignment
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51
52
MD1
MD2
V
CC
-R
TC
XT
AL2
EXT
AL2
V
SS
-R
TC
NMI
IRQ0/
IRL0
/PTH[0]
IRQ1/
IRL1
/PTH[1]
IRQ2/
IRL2
/PTH[2]
IRQ3/
IRL3
/PTH[3]
IRQ4/PTH[4]
D31/PTB[7]
D30/PTB[6]
D29/PTB[5]
D28/PTB[4]
D27/PTB[3]
D26/PTB[2]
V
SS
Q
D25/PTB[1]
V
CC
Q
D24/PTB[0]
D23/PT
A[7]
D22/PT
A[6]
D21/PT
A[5]
D20/PT
A[4]
V
SS
D19/PT
A[3]
V
CC
D18/PT
A[2]
D17/PT
A[1]
D16/PT
A[0]
V
SS
Q
D15
V
CC
Q
D14
D13
D12
D11
D10
D9
D8
D7
D6
V
SS
Q
D5
V
CC
Q
D4
D3
D2
D1
D0
156
155
154
153
152
151
150
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107
106
105
EXT
AL
XT
AL
V
CC
V
SS
V
SS
A
UDCK/PTH[6]
V
CC
-PLL2
CAP2
V
SS
-PLL2
V
SS
-PLL1
CAP1
V
CC
-PLL1
MD0
IRLS0
/PTF[0]/PINT[8]
IRLS1
/PTF[1]/PINT[9]
IRLS2
/PTF[2]/PINT[10]
IRLS3
/PTF[3]/PINT[11]
TCK/PTF[4]/PINT[12]
TDI/PTF[5]/PINT[13]
TMS/PTF[6]/PINT[14]
TRST
/PTF[7]/PINT[15]
A
U
D
A
T
A[0]/PTG[0]
V
CC
A
U
D
A
T
A[1]/PTG[1]
V
SS
A
U
D
A
T
A[2]/PTG[2]
A
U
D
A
T
A[3]/PTG[3]
PTG[4]/CKIO2
ASEBRKAK
/PTG[5]
ASEMD0
/PTG[6]
IOIS16
/PTG[7]
ADTRG
/PTH[5]
RESETM WAIT BREQ BACK
TDO/PTE[0]
PTE[1]
RAS3U
/PTE[2]
PTE[3]
PTE[6]
D
A
CK1/PTD[7]
D
A
CK0/PTD[5]
PTJ[5]
PTJ[4]
V
CC
Q
CASU
/PTJ[3]
V
SS
Q
CASL
/PTJ[2]
PTJ[1]
RAS3L
/PTJ[0]
CKE/PTK[5]
157
158
159
160
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200
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202
203
204
205
206
207
208
STATUS0/PTJ[6]
STATUS1/PTJ[7]
TCLK/PTH[7]
I
RQOUT
V
SS
Q
CKIO
V
CC
Q
TxD0/SCPT[0]
SCK0/SCPT[1]
TxD1/SCPT[2]
SCK1/SCPT[3]
TxD2/SCPT[4]
SCK2/SCPT[5]
RTS2
/SCPT[6]
RxD0/SCPT[0]
RxD1/SCPT[2]
V
SS
RXD2/SCPT[4]
V
CC
CTS2
/IRQ5/SCPT[7]
MCS[7]
/PTC[7]/PINT[7]
MCS[6]
/PTC[6]/PINT[6]
MCS[5]
/PTC[5]/PINT[5]
MCS[4]
/PTC[4]/PINT[4]
V
SS
Q
WAKEUP
/PTD[3]
V
CC
Q
RESETOUT
/PTD[2]
MCS[3]
/PTC[3]/PINT[3]
MCS[2]
/PTC[2]/PINT[2]
MCS[1]
/PTC[1]/PINT[1]
MCS[0]
/PTC[0]/PINT[0]
DRAK0/PTD[1]
DRAK1/PTD[0]
DREQ0
/PTD[4]
DREQ1
/PTD[6]
RESETP
CA
MD3
MD4
MD5
AV
SS
AN[0]/PTL[0]
AN[1]/PTL[1]
AN[2]/PTL[2]
AN[3]/PTL[3]
AN[4]/PTL[4]
AN[5]/PTL[5]
AV
CC
AN[6]/DA[1]/PTL[6]
AN[7]/DA[0]/PTL[7]
AV
SS
104
103
102
101
100
99
98
97
96
95
94
93
92
91
90
89
88
87
86
85
84
83
82
81
80
79
78
77
76
75
74
73
72
71
70
69
68
67
66
65
64
63
62
61
60
59
58
57
56
55
54
53
CE2B
/PTE[5]
CE2A
/PTE[4]
CS6
/
CE1B
CS5/CE1A
/PTK[3]
CS4
/PTK[2]
CS3
/PTK[1]
CS2
/PTK[0]
V
CC
Q
CS0
/
MCS0
V
SS
Q
AUDSYNC
/PTE[7]
RD/
WR
WE3
/DQMUU/ICIOWR/PTK[7]
WE2
/DQMUL/ICIORD/PTK[6]
WE1
/DOMLU/WE
WE0
/DQMLL
RD
BS
/PTK[4]
A25
V
CC
Q
A24
V
SS
Q
A23
V
CC
A22
V
SS
A21
A20
A19
A18
A17
A16
A15
V
CC
Q
A14
V
SS
Q
A13
A12
A11
A10
A9
A8
A7
A6
A5
V
CC
Q
A4
V
SS
Q
A3
A2
A1
A0
SH7709S
FP-208C
FP-208E
(Top view)
INDEX MARK
Figure 1.2 Pin Assignment (FP-208C, FP-208E)
Содержание SH7709S
Страница 2: ...Hitachi SuperH RISC engine SH7709S Hardware Manual ADE 602 250 Rev 1 0 09 21 01 Hitachi Ltd ...
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Страница 292: ...273 T1 CKIO A25 to A0 CSn RD WR RD D31 to D0 WEn D31 to D0 BS T2 Read Write Figure 10 6 Basic Timing of Basic Interface ...
Страница 323: ...304 Tp TRr TRrw TRrw CKIO CKE CSn RAS3U RAS3L CASU CASL RD WR Figure 10 28 Synchronous DRAM Auto Refresh Timing ...
Страница 411: ...392 ...
Страница 609: ...590 ...
Страница 635: ...616 ...
Страница 663: ...644 ...
Страница 679: ...660 ...