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10006609-03
Pm8560
User’s Manual
i
Registers
Register 7-1:
PCI1 Vendor and Device ID . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 7-2
Register 7-2:
MPC8560 PCI Configuration Space Header . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 7-4
Register 8-1:
Product ID (PIDR), 0x00 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8-2
Register 8-2:
Hardware Version (HVR), 0x04 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8-2
Register 8-3:
PLD Version (PVR), 0x08 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8-3
Register 8-4:
PLL Configuration (PLLCR), 0x0C . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8-3
Register 8-5:
Hardware Configuration 1 (HCR1), 0x14 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8-4
Register 8-6:
Jumper Settings (JSR), 0x18 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8-5
Register 8-7:
LED (LEDR), 0x1C . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8-5
Register 8-8:
Reset Event (RER), 0x20 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8-6
Register 8-9:
Reset Command (RCR), 0x24 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8-7
Register 8-10: PCI Reset Out Enable (PROE), 0x28 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8-8
Register 8-11: PCI Status (PSR), 0x2C . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8-9
Register 8-12: Boot Device Failover Mechanism (BDFM), 0x30 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8-10
Register 8-13: Miscellaneous Control (MISC), 0x34 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8-11
Register 8-14: CT Bus Status (CTSR), 0x38 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8-12
Register 8-15: NETREF Control (NRCR), 0x40 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8-14
Register 8-16: Framer Clock Source (FCSR), 0x44 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8-14
Register 8-17: MT4095 System Synchronizer Control (SSCR), 0x48 . . . . . . . . . . . . . . . . . . . . . . . . . . 8-15
Register 8-18: SYNC Source (SSR), 0x4C . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8-16
Register 8-19: Primary Clock Source (PCSR), 0x50 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8-17
Register 8-20: Secondary Clock Source (SCSR), 0x54 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8-18
Register 8-21: TCLK Source (TCSR), 0x58 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8-19
Register 8-22: RCLK Source (RCSR), 0x5C . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8-19
Register 8-23: SPD Row Column (SPDRC), 0x60 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8-20
Register 8-24: SPD CAS Latency Refresh (SPDCLR), 0x64 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8-21
Register 8-25: SPD SDRAM Cycle Time for CAS Latency (SPDCT), 0x68 . . . . . . . . . . . . . . . . . . . . . . . 8-21
Register 8-26: SPD Minimum Row Precharge Time (SPDMRP), 0x6C . . . . . . . . . . . . . . . . . . . . . . . . . 8-22
Register 8-27: SPD Minimum Row Delay Between Activations (SPDMDBRA), 0x70 . . . . . . . . . . . . 8-23
Register 8-28: SPD Minimum Row Delay Between RAS-to-CAS Assertions (SPDMDBRCA), 0x74 . 8-23
Register 8-29: SPD Minimum Active-to-Precharge (SPDMAP), 0x78 . . . . . . . . . . . . . . . . . . . . . . . . . 8-24
Register 8-30: SPD Minimum Auto-Refresh to Active/Auto-Refresh (SPDMAA), 0x7C . . . . . . . . . . 8-24
Register 8-31: SPD Write Recovery Time (SPDWRT), 0x80 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8-25
Register 8-32: SPD Internal Write-to-Read Command Delay (SPDIWR), 0x84 . . . . . . . . . . . . . . . . . 8-25
Summary of Contents for Pm8560
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Page 72: ...PCI Bus Interface PMC Connector Pin Assignments Pm8560 User s Manual 10006609 03 7 10 ...
Page 112: ...Development Mezzanine Card Troubleshooting Pm8560 User s Manual 10006609 03 10 12 ...
Page 138: ...Monitor Download Formats Pm8560 User s Manual 10006609 03 11 26 ...
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