GRUNDIG Service
2 - 5
j
GDV 100 D
Beschreibung
7111
MC68340-PV25
113
48
51
52
53
55
56
57
60
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99
102
101
83
100
95
1
2
3
5
28
22
144
132
131
128
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15
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96
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118
129
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139
6
18
30
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27
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21
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24
26
92
94
110
119
130
140
7
19
31
41
50
86
59
68
74
90
17
20
93
89
X1
IACK1N
IACK2N
IACK3N
IACK4N
IACK5N
IACK6N
IACK7N
IRQ7N
IRQ6N
IRQ5N
IRQ3N
CS3N
CS2N
CS1N
CS0N
FC3
FC2
FC1
FC0
TOUT1
TIN1
TGATE1
TOUT2
TIN2
TGATE2
DSACK0N
DSACK1N
SIZ0
SIZ1
R/WN
DSN
ASN
VCC14
VCC12
A24
TXRDYN
RTS2N
CTS2N
RTS1N
CTS1N
VCC11
VCC15
TXD2
RXD2
TXD1
RXD1
GND13
GND11
TDO
TDI
TCK
TMS
A23
A22
A21
A20
A19
A18
A17
A16
A15
A14
A13
A12
A11
A10
A9
A8
A7
A6
A5
A4
A3
A2
A1
A0
GND14
GND12
RXRDYN
VCC13
GND1
VCC1
GND2
VCC2
GND3
VCC3
GND4
VCC4
GND5
VCC5
GND6
VCC6
RMCN
BGN
BGACKN
BRN
RESETN
HALTN
BERRN
D15
D14
D13
D12
D11
D10
D9
D8
D7
D6
D5
D4
D3
D2
D1
D0
GND15
XTAL
EXTAL
CLKOUT
MODCK
X2
SCLK
BKPTN
FREEZE
IPIPEN
IFETCHN
VCCSYN
XFC
DONE2N
DACK2N
DREQ2N
DONE1N
DACK1N
DREQ1N
GND7
GND16
VCC7
GND8
VCC8
GND9
VCC9
GND10
VCC10
SELECT
CHIP
PORT
PORT
A
B
MODULLE
MODULLE
TIMER
TIMER
CPU 32
CORE
CLOCK
ARBITRATION
BUS
CONTROL
CHANNEL
DMA
TWO
BUS INTERFACE
EXTERNAL
CHANNEL
OUTPUT
SERIAL
TEST
I/O
TWO-
PORT
INTEGRATION
MODULE
SYSTEM
IC7111
MC68340PV: HOST-Prozessor
Funktionsübersicht
Der HOST-Prozessor IC7111 verfügt über folgende Features:
– CPU32-MC68020 ist ein abgeleiteter 32-Bit-Prozessor
– 32 Adressleitungen, 16 Datenleitungen
– 2 DMA-Controller für schnellen Speicherzugriff
– 2 serielle synchrone/asynchrone I/O-Schnittstellen (USART). Diese
dienen zur Kommunikation mit dem Laufwerk (S2B)
– 2 unabhängige Zähler/Timer
– integrierte Treiber für TTL und ASIC, z.B. ELPD
– Taktfrequenz: 32,768MHz
– Taktfrequenz der USART-Schnittstelle: 3,6864MHz.
IC7110
ispLSI 2032: Programmierbare Logik hoher Dichte
Funktionsübersicht
Der IC7110 erweitert die Chip-Select-Ausgänge des HOST-Prozes-
sors IC7111. In Abhängigkeit von den Adresseingängen A[18:21] und
den Chip-Select-Eingängen CS[0:2] werden die Chip-Select-Ausgän-
ge gesetzt für den "Digital Stream Manager", den Digital Video
Prozessor, den MPEG-Decoder, und den I
2
C-Bus-Controller. Des
weiteren steuert dieser die Freigabeeingänge der FLASH- und EPROM-
Speicher.
Aus dem 27MHz-Systemtakt erzeugt der IC7110 den 6,75MHz-I
2
C-
Bus-Takt (Frequenzteilung durch 4).
Der IC7110 ist auch das Interface zwischen der CPU und dem DRAM-
Controller.
Pin-Name
Funktion
Beschreibung
A[23:0]
Address-Bus
Untere 24 Bits des Adressbusses
ASN
Address Strobe
Hinweis, daß sich eine gültige Adresse auf dem Adressbus befindet
BERRN
Bus Error
Hinweis, daß eine falsche Operation am Bus versucht wird
BGACKN
Bus Grant Acknowledge
Hinweis, daß eine externe Komponenten die Masterrolle über den Bus übernommen hat
BGN
Bus Grant
Hinweis, daß der gegenwärtige Buszyklus abgeschlossen ist
BKPTN
Breakpoint
Hinweis auf eine Unterbrechung in der Hardware zum CPU32
BRN
Bus Request
Hinweis, daß eine externe Komponenten die Übernahme der Masterrolle über den Bus benötigt
CLKOUT
System Clock Out
Interner Systemtakt
CS[3:0]N
Chip Select
Aktivierung peripherer Schaltungen an den programmierten Adressen
CTS1N, CTS2N
Clear To Send
serielles Modul bereit zu senden
D[15:0]
Data bus
16-bit Datenbus soll Bytes oder Wörter übertragen
DACK1N, DACK2N
DMA Acknowledge
Ausgang, der einen Zugriff während des DMA-Prozesses signalisiert
DONE1N, DONE2N
DMA Done
Bidirektionales Signal, daß die letzte Übertragung anzeigt
DREQ1N, DREQ2N
DMA Request
Eingangssignal zum Starten des DMA-Prozesses
DSACK[1:0]N
Data and Size Acknowledge
Für asynchrone Datentransfers und dynamische Daten über Busgröße
DSN
Data Strobe
Während eines Schreibzyklus weist DS darauf hin, daß eine externe Komponente gültige Daten auf den Datenbus schicken soll
EXTAL, XTAL
Crystal Oscillator
Anschlüsse für einen externen Quarzoszillator
FREEZE
Freeze
zeigt an, daß der CPU32 eine Unterbrechung bestätigt hat
HALTN
Halt
stellt Aktivitäten auf dem externen Bus ein
IACK[7:0]
Interrupt Acknowledge
Interrupt-Bestätigungsleitungen