EN 157
3139 785 32804
8.
IC Internal Block Diagrams
PIN CONFIGURATION
HSYNC
VSYNC
CGND
CVCC18
SPDIF
MCLK
SD3
SD2
SD1
SD0
WS
SCK
IOVCC
IOGND
CGND
CVCC18
AG
ND
TX
C-
TX
C+
AV
CC
TX
0-
TX
0+
AG
ND
TX
1-
TX
1+
AV
CC
TX
2-
TX
2+
AG
ND
PV
CC
2
PG
ND
2
CVCC18
CGND
IOGND
IOVCC
D23
D22
D21
D20
D19
D18
D17
D16
D15
D14
CVCC18
CGND
D
1
3
D
1
2
D
1
1
D
1
0
D
9
ID
C
K
D
8
D
7
D
6
D
5
IO
V
C
C
IO
G
N
D
C
G
N
D
C
V
C
C
1
8
D
4
D
3
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
2
5
2
6
2
7
2
8
2
9
3
0
3
1
3
2
3
3
3
4
3
5
3
6
3
7
3
8
3
9
4
0
45
46
47
48
49
50
51
52
53
54
55
56
57
58
59
60
6
1
6
2
6
3
6
4
6
5
6
6
6
7
6
8
6
9
7
0
7
1
7
2
7
3
7
4
7
5
7
6
N
C
INT
HPD
DSDA
DSCL
17
18
19
20
R
S
V
D
L
P
G
N
D
1
P
V
C
C
1
E
X
T
_
S
W
IN
G
2
1
2
2
2
3
2
4
CI2CA
RESET#
CSCL
CSDA
41
42
43
44
D
2
D
1
D
0
D
E
7
7
7
8
7
9
8
0
SiI
9030
80-Pin TQFP
)
(Top View
Figure 8-17
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