National Instruments PXIe-6569, Getting Started Manual

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Figure 4.
PXIe-6569 with 32 LVDS In, 32 LVDS Out, Rows D-C
Connector Signal FPGA Signal
GND
GND
SE 6
SE_GND_TERM
SE 7
SE_GND_TERM
DO 21+
DO 21-
GND
DO 22+
DO 22-
GND
DO 23+
DO 23-
GND
DO 24+
DO 24-
GND
DO 25+
DO 25-
GND
DO 26+
DO 26-
GND
DO 27+
DO 27-
GND
DO 28+
DO 28-
GND
DO 29+
DO 29-
GND
DO 30+
DO 30-
GND
DO 31+
DO 31-
GND
GND
D4
D1
D2
D3
D5
D6
D8
D9
D10
D11
D12
D13
D14
D15
D16
D17
D18
D19
D20
D21
D22
D23
D24
D25
D26
D27
D28
D29
D30
D31
D32
D33
D34
D35
D36
D37
D38
D39
D7
D40
Connector Signal FPGA Signal
aSeGpio(5)
aSeGpio(7)
aDiffGpio_p(0)
aDiffGpio_n(0)
aDiffGpio_p(1)
aDiffGpio_n(1)
aDiffGpio_p(3)
aDiffGpio_n(3)
aDiffGpio_p(5)
aDiffGpio_n(5)
aDiffGpio_p(9)
aDiffGpio_n(9)
aDiffGpio_p(7)
aDiffGpio_n(7)
aDiffGpio_p(2)
aDiffGpio_n(2)
aDiffGpio_p(10)
aDiffGpio_n(10)
aDiffGpio_p(15)*
aDiffGpio_n(15)*
aDiffGpio_p(13)
aDiffGpio_n(13)
aDiffGpio_p(6)
aDiffGpio_n(6)
GND
GND
SE 2
SE_GND_TERM
SE 3
SE_GND_TERM
DI 21+
DI 21-
GND
DI 22+
DI 22-
GND
DI 23+
DI 23-
GND
DI 24+
DI 24-
GND
DI 25+
DI 25-
GND
DI 26+
DI 26-
GND
DI 27+
DI 27-
GND
DI 28+
DI 28-
GND
DI 29+*
DI 29-*
GND
DI 30+
DI 30-
GND
DI 31+
DI 31-
GND
GND
C4
C1
C2
C3
C5
C6
C8
C9
C10
C11
C12
C13
C14
C15
C16
C17
C18
C19
C20
C21
C22
C23
C24
C25
C26
C27
C28
C29
C30
C31
C32
C33
C34
C35
C36
C37
C38
C39
C40
C7
Bank
45
Bank
45
aSeGpio(13)
aSeGpio(15)
aDiffGpio_p(4)
aDiffGpio_n(4)
aDiffGpio_p(8)
aDiffGpio_n(8)
aDiffGpio_p(12)
aDiffGpio_n(12)
aDiffGpio_p(11)
aDiffGpio_n(11)
aDiffGpio_p(16)
aDiffGpio_n(16)
aDiffGpio_p(14)
aDiffGpio_n(14)
aDiffGpio_p(19)
aDiffGpio_n(19)
aDiffGpio_p(17)
aDiffGpio_n(17)
aDiffGpio_p(21)
aDiffGpio_n(21)
aDiffGpio_p(20)
aDiffGpio_n(20)
aDiffGpio_p(18)
aDiffGpio_n(18)
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