
Circuit Diagrams and PWB Layouts
10.
10-2-30
B, FPGA - DDR
19570_115_140603.eps
14-06-03
FPGA - DDR
B
B
2014-02-21
3
715RLPCB000000030
MV UHD HDMI20-420
C9
DQSL
DQSL
DQSU2
DQSU1
DMU
DML
RESET
WE
CS
CKE
CK
CK
CAS
ODT
RAS
ZQ
VREFCA
VREFDQ
NC
7
6
5
4
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1
0
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7
6
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1
0
DQL
0
1
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BA
VDD
VDDQ
VSS
VSSQ
0
1
2
3
4
5
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7
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9
10
11
12
13
14
A
BC
AP
DQSL
DQSL
DQSU2
DQSU1
DMU
DML
RESET
WE
CS
CKE
CK
CK
CAS
ODT
RAS
ZQ
VREFCA
VREFDQ
NC
7
6
5
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7
6
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VDDQ
VSS
VSSQ
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14
A
BC
AP
B2
D9
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K2
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F1
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H9
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L9
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F2
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G3
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P1
P9
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B9
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G9
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L7
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P2
P8
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P3
P7
N3
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C7
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M7
T3
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GND
1K
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1%
+1V5-BEDDRA
240
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1%
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C245B
R154B
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D9
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GND
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1%
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1%
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D063B
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100nF
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C224B
100nF
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100nF
16V
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BEDDRA-DQU6
BEDDRA-DQU7
BEDDRA-DQL1
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BEDDRA-DQL4
BEDDRA-DQL5
BEDDRA-DQL6
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BEDDRB-DQSU-N
BEDDRB-DQSU-P
BEDDRB-DML
BEDDRB-DMU
BEDDRB-BA0
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BEDDRB-ODT
BEDDRB-CASn
BEDDRB-CKE
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BEDDRB-WEn
BEDDRB-RSTn
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BEDDRA-MA3
BEDDRA-MA4
BEDDRA-MA5
BEDDRA-MA6
BEDDRA-MA7
BEDDRA-MA8
BEDDRA-MA9
BEDDRA-MA10
BEDDRA-MA11
BEDDRA-MA12
BEDDRA-MA13
BEDDRB-MA0
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BEDDRB-MA4
BEDDRB-MA5
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BEDDRB-MA7
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BEDDRB-MA10
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BEDDRB-MA12
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10nF
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RES
C175B
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RES
16V
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RES
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RES
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X005B
+1V5-BE
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10uF
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16V
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RES
16V
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+1V5-BEDDRB
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100nF
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1%
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100
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BEDDRB-CLKB-P
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I053B
I054B