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Beispiele und Registerbelegungen

4.3 Register

SIMATIC PCIe DIO4

Kompaktbetriebsanleitung, 11/2011, A5E03493449-01

INPIF: Eingangsinterrupt-Flag-Register (BASE + 0x0110)

Bit

Zugriff Name

Default Beschreibung

31..0

RWC

IFx

Jedes Bit spiegelt den Interruptzustand des

entsprechenden Eingangs wieder. Wenn ein Bit gesetzt

wird, wird STATUS.IIF gesetzt. Wenn das Bit mit "1"

beschrieben wird, wird das Bit zurückgesetzt, ebenfalls

die entsprechenden IFRE/IFFE-Bits.

INPIFR: Eingangsinterrupt-Flag-Register, steigende Flanke (BASE + 0x0120)

Bit

Zugriff Name

Default Beschreibung

31..0

RWC

IFREx

Jedes Bit spiegelt den Interruptzustand steigender

Flanke des entsprechenden Eingangs wieder. Wenn ein

Bit gesetzt wird, wird STATUS.IIF gesetzt. Wenn das Bit

gesetzt wird, wird das entsprechende INPUTIF.IF

gesetzt. Wenn das Bit mit "1" beschrieben wird, wird das

Bit zurückgesetzt.

INPIFF: Eingangsinterrupt-Flag-Register, fallende Flanke (BASE + 0x0130)

Bit

Zugriff Name

Default Beschreibung

31..0

RWC

IFFEx

Jedes Bit spiegelt den Interruptzustand fallender Flanke

des entsprechenden Eingangs wieder. Wenn das Bit

gesetzt wird, wird das entsprechende INPUTIF.IF

gesetzt. Wenn das Bit mit "1" beschrieben wird, wird das

Bit zurückgesetzt.

INPxC: Eingang x Configuration-Register (BASE + (x*8))

Bit

Zugriff Name

Default Beschreibung

63..16 RO

Reserviert

15..10 RW

FSRATE 0

Sample-Frequenz Eingangsfilter f

= 62,5 MHz /

(FSRATE << 12).

9..8

FTHRES 0

Sample-Threshold Eingangsfilter. 00: 1 Sample, 01: 3

Samples, 10: 5 Samples, 11: 7 Samples.

7..4

Reserviert

ENFEI

Aktiviert einen Interrupt bei fallender Flanke des

Eingangssignals. Wenn das Bit gesetzt ist und eine

fallende Flanke am Eingang detektiert wird, wird das

entsprechende Bit in INPIFF.IFFE gesetzt.

ENREI

Aktiviert einen Interrupt bei steigender Flanke des

Eingangssignals. Wenn das Bit gesetzt ist und eine

steigende Flanke am Eingang detektiert wird, wird das

entsprechende Bit in INPIFR.IFRE gesetzt.

ENF

Aktiviert den Eingangsfilter. Wenn "1", wird der Eingang

gefiltert mit den Einstellungen von FSRATE und

FTHRES.

INV

Wenn "1", wird das Eingangssignal invertiert, bevor es

weiter verarbeitet wird.

Содержание SIMATIC PCIe DIO4

Страница 1: ...ATIC Rack PC 547B ______________ ______________ ______________ ______________ ______________ ______________ SIMATIC Industrial PC SIMATIC PCIe DIO4 Kompaktbetriebsanleitung Compact Operating Instructions 11 2011 A5E03493449 01 ...

Страница 2: ...SIMATIC IPC227D Compact Operating Instructions 11 2011 A5E03493449 01 ...

Страница 3: ...____________ ___________________ ___________________ SIMATIC Industrie PC SIMATIC PCIe DIO4 Kompaktbetriebsanleitung 11 2011 A5E03493449 01 Überblick 1 DIO Baugruppe einbauen und anschließen 2 Technische Angaben 3 Beispiele und Registerbelegungen 4 ...

Страница 4: ...chtung der für die jeweilige Aufgabenstellung zugehörigen Dokumentation insbesondere der darin enthaltenen Sicherheits und Warnhinweise Qualifiziertes Personal ist auf Grund seiner Ausbildung und Erfahrung befähigt im Umgang mit diesen Produkten Systemen Risiken zu erkennen und mögliche Gefährdungen zu vermeiden Bestimmungsgemäßer Gebrauch von Siemens Produkten Beachten Sie Folgendes WARNUNG Sieme...

Страница 5: ...augruppe 6 1 3 1 Input 7 1 3 2 Output 8 1 3 3 Counter 9 2 DIO Baugruppe einbauen und anschließen 11 2 1 Wichtiger Einbauhinweis 11 2 2 Stromversorgung für die Ausgänge anschließen 11 3 Technische Angaben 13 3 1 Anschlussbelegung 13 3 2 Technische Daten 14 4 Beispiele und Registerbelegungen 17 4 1 DIO initialisieren und freigeben 17 4 2 Beispiele 18 4 3 Register 20 ...

Страница 6: ...Inhaltsverzeichnis SIMATIC PCIe DIO4 4 Kompaktbetriebsanleitung 11 2011 A5E03493449 01 ...

Страница 7: ...tung in den Release Notes und in der Online Hilfe in der Verbindlichkeit übergeordnet 1 2 Produktbeschreibung Die DIO Baugruppe ist eine PCIe x1 Baugruppe und stellt vier digitale 24 V Eingänge und vier digitale 24 V Ausgänge zur Verfügung Darüber hinaus bietet die DIO Baugruppe acht hardwarebasierte Zähler 62 5 MHz Basistakt die für Funktionen wie PWM Frequenzmessung und Pulsbreitenmessung konfig...

Страница 8: ...nde reagieren z B Nulldurchgang Überlauf 1 3 Aufbau der DIO Baugruppe Die DIO Baugruppe besteht aus drei Hauptteilen Input Output Counter QSXW 13 13 13 5 QYHUVLRQ QSXW ILOWHU GJH GHWHFWLRQ QSXW LQWHUUXSW UHJLVWHUV QSXW UHJLVWHU 13 13 QSXW FRQILJXUDWLRQ UHJLVWHU 2XWSXW LQWHUUXSW UHJLVWHUV 2XWSXW UHJLVWHU 2873 2873 2XWSXW FRQILJXUDWLRQ UHJLVWHU 2XWSXW GJH GHWHFWLRQ 6RXUFH VHOHFWLRQ QYHUVLRQ PRGH 287...

Страница 9: ... FSRATE 12 Beispiel Sample Periode von 1 ms INPxC FSRATE 0xF Sample Threshold von 5 INPxC FTHRES 0x02 Das Eingangssignal muss für mindestens 5 ms den gleichen Pegel haben bis das Eingangssignal durchgereicht wird Eingangsinterrupts Für jeden Eingang lassen sich Interrupts bei steigender fallender oder bei beiden Flanken des Eingangssignals konfigurieren INPxC ENREI aktiviert einen Interrupt bei st...

Страница 10: ...WM Ausgangsinterrupts Für jeden Ausgang lassen sich Interrupts bei steigender fallender oder bei beiden Flanken des Ausgangssignals konfigurieren OUTPxC ENREI aktiviert einen Interrupt bei steigender Flanke OUTPxC ENFEI aktiviert einen Interrupt bei fallender Flanke Wenn einer oder beide Interrupts aktiviert sind und eine Flanke detektiert wird geschieht Folgendes Die entsprechenden Bits in OUTPIF...

Страница 11: ...xTR4 Compare CxCOMR enthält den Compare Wert 5 6 RPSDUH VHOHFWLRQ 205 RPSDUH UHJLVWHU RPSDUDWRU 65 65 65 6 65 2 DSWXUH UHJLVWHU 35 DSWXUH 75 RXQWHU UHJLVWHU 2YHUIORZ 95 8S RZQ OHDU 5HORDG 5HORDG UHJLVWHU 55 75 75 75 75 Counter Der Counter ist ein 36 Bit Zähler der mit einem Takt von 62 5 MHz betrieben wird Bei andauerndem Hochzählen läuft der Counter nach ca 1099 5 s über Der Überlauf wird durch d...

Страница 12: ...TRx PRE Ausgangs Modus CxTRx OMODE 6RXUFH VHOHFWLRQ HYHO KLJK HYHO ORZ GJH ULVLQJ GJH IDOOLQJ RWK HGJHV QSXW Q 7RJJOH PRGH 1RUPDO PRGH Q 2XW YHQW RXWSXW YHQW VRXUFHV HWHFW PRGH 3UHVFDOHU 2XWSXW PRGH Event Wirkung Event Up CxTR0 Der Counter wird inkrementiert Event Down CxTR1 Der Counter wird dekrementiert Event Clear CxTR2 Der Counter wird gelöscht 0 Event Reload CxTR3 Der Wert aus dem Reload Regi...

Страница 13: ...e DIO Baugruppe korrekt gesteckt ist digitale Ein und Ausgänge außen Falls Sie doch die DIO Baugruppe verkehrt stecken und versehentlich in Betrieb nehmen ziehen Sie die Baugruppe ab und senden Sie sie zur Reparatur ein 2 2 Stromversorgung für die Ausgänge anschließen Für die 24 V Stromversorgungsleitung benötigen Sie den mitgelieferten Klapp Ferrit der Firma Würth Bestellnummer 742711112 ACHTUNG ...

Страница 14: ...mversorgung für die Ausgänge mit Pin 10 P24V_EXT 3LQ 0B287 3LQ 3 9B 7 2 Verbinden Sie den Masseanschluss der Stromversorgung für die Ausgänge mit Pin 9 M_OUT 3 Führen Sie die 24 V Stromversorgungsleitung für die Ausgänge durch das geöffnete Gehäuse des mitgelieferten Klapp Ferrit 4 Führen Sie die 24 V Stromversorgungsleitung einmal um das Gehäuse des Klapp Ferrit herum 5 Schließen Sie das Gehäuse ...

Страница 15: ... Anschlussbelegung B287 B287 B287 B287 B 1 B 1 B 1 B 1 3LQ 287 3LQ 0B287 3LQ 287 3LQ 0B287 3LQ 287 3LQ 0B287 3LQ 287 3LQ 0B287 3LQ 3 9B 7 3LQ 0B287 3LQ 1 3LQ 0B 1 3LQ 1 3LQ 0B 1 3LQ 1 3LQ 0B 1 3LQ 1 3LQ 0B 1 0B 1 SRWHQ LDOJHWUHQQWHV 0 1 0B287 0 1 GHU XVJ QJH 3 9B 7 9 LQVSHLVXQJ I U GLH XVJ QJH ...

Страница 16: ... der Norm EN 61000 6 3 2007 Fachgrundnormen Störaussendung für Wohnbereich Geschäfts und Gewerbebereiche sowie Kleinbetriebe werden nicht erfüllt Störfestigkeit EN 61000 6 2 2005 Komponenten für den Überspannungsschutz Lfd Nr Leitung für Komponente 1 Artikel Nr 1 Versorgung UN DC 24 V BLITZDUCTOR VT BVT AD 24 918 402 2 Eingänge von digitalen Baugruppen UN DC 24 V DEHNconnect RK DCO RK ME 24 IL 0 5...

Страница 17: ... Statusanzeige orange LED pro Kanal Ansteuerung über Logik nicht direkt am Eingangssignal angeschlossen Digitalausgänge Anzahl der Ausgänge 4 Erforderlicher Stecker 10 polig Weidmueller B2L 3 50 10 180 SN BK BX Betsllnr 1727660000 Querschnitt der Anschlussleitungen am Stecker 0 08 mm2 1 3 mm2 Ausgänge Interruptfähig Ja auf steigende Flanke fallende Flanke oder beide Flanken Integrierte Sicherung J...

Страница 18: ... max 0 5 Hz Lastwiderstandsbereich 48 Ω 4 kΩ Ausgänge haben einen definierten Zustand Nach einem Reset Ausgänge sind NULL Low Bei System Stillstand Absturz Ausgänge bleiben im letzten eingestellten Zustand und können über Geräte Watchdog rückgesetzt werden Zähler Anzahl der Zähler 8 Auflösung 36 Bit 16 ns Verknüpfung der Eingänge mit Zähler Beliebig Verknüpfung der Ausgänge mit Zähler Beliebig Zäh...

Страница 19: ... Flag verhindert dass mehrere Software Kompenenten gleichzeitig auf die DIO zugreifen Bevor eine Software auf die DIO zugreift muss die Software über das INUSE Flag prüfen ob die Baugruppe bereits in Verwendung ist Beim ersten Lesen des Global Status Registers GSR muss das INUSE Bit 0 ergeben Alle weiteren Lese Zugriffe ergeben 1 Die DIO ist in Verwendung 4 Setzen Sie GCR EN Die DIO wird aktiviert...

Страница 20: ...en ist Beispiel 4 Interrupt bei steigender Flanke an Eingang 0 auslösen Bei steigender Flanke an Eingang 0 soll ein Interrupt ausgelöst werden Aktivieren Sie den entsprechenden Eingangsinterrupt und die globalen Interrupts wie folgt Berechnen Sie die Konfigurationsadresse INP0C BASE 0x200 0 8 BASE 0x200 Aktivieren Sie den Eingangsinterrupt bei steigender Flanke Setzen Sie INP0C ENREI INP0C 0x04 Ak...

Страница 21: ...ASE 0x1000 3 0x100 BASE 0x1300 Event Up programmieren C3TR0 0x0100 Source 0x01 Always on Event Clear programmieren C3TR2 0x2B08 Source 0x2B Eingang 3 0x08 Steigende Flanke Event Capture programmieren C3TR4 0x2B08 Source 0x2B Eingang 3 0x08 Steigende Flanke C3 aktivieren C3CR EN 1 Die Frequenz berechnet sich dann wie folgt f3 1 C3CAPR 1 16 ns Beispiel 7 Pulslänge an Eingang 2 messen In diesem Beisp...

Страница 22: ...0120 32 RWC INPIFR Eingänge 0 31 Interrupt Flags steigende Flanke BASE 0x0130 32 RWC INPIFF Eingänge 0 31 Interrupt Flags fallende Flanke BASE 0x0200 64 RW INP0C Konfiguration von Eingang 0 Filter Invertierung Interrupt BASE 0x0208 64 RW INP1C Konfiguration von Eingang 1 Filter Invertierung Interrupt BASE 0x0210 64 RW INP2C Konfiguration von Eingang 2 Filter Invertierung Interrupt BASE 0x0218 64 R...

Страница 23: ...ister 0 Up BASE 0x1028 32 RW C0TR1 Counter 0 Trigger Register 1 Down BASE 0x1030 32 RW C0TR2 Counter 0 Trigger Register 2 Clear BASE 0x1038 32 RW C0TR3 Counter 0 Trigger Register 3 Reload BASE 0x1040 32 RW C0TR4 Counter 0 Trigger Register 4 Capture BASE 0x1060 56 RW C0COMR Counter 0 Compare Register BASE 0x1070 56 RW C0RELR Counter 0 Reload Register BASE 0x1078 56 RW C0CAPR Counter 0 Capture Regis...

Страница 24: ...VER Version BASE 0x0000 Bit Zugriff Name Default Beschreibung 31 RO 0 Reserviert 30 26 RO NRCT 8 Anzahl Zähler Zeitgeber 25 21 RO NROP 4 Anzahl Ausgangssignale 20 16 RO NRIP 4 Anzahl Eingangssignale 15 8 RO REV 00 Revision 7 0 RO VER 10 Version des DIO Interface 1 0 GCR General Control Register BASE 0x0004 Bit Zugriff Name Default Beschreibung 31 10 RO 0 Reserviert 9 RW GATERST 0 Wenn 1 wird der e...

Страница 25: ...le aktivierten Counter Interrupts gelöscht werden wird das Bit zurückgesetzt 3 RO OIF 0 Output Interrupt Flag Wenn dieses Flag gesetzt wurde hat ein Ausgang einen Interrupt ausgelöst Wenn alle aktivierten Ausgangsinterrupts gelöscht werden wird das Bit zurückgesetzt 2 RO IIF 0 Eingang Interrupt Flag Wenn dieses Flag gesetzt wurde hat ein Eingang einen Interrupt ausgelöst Wenn alle aktivierten Eing...

Страница 26: ...RWC IFFEx 0 Jedes Bit spiegelt den Interruptzustand fallender Flanke des entsprechenden Eingangs wieder Wenn das Bit gesetzt wird wird das entsprechende INPUTIF IF gesetzt Wenn das Bit mit 1 beschrieben wird wird das Bit zurückgesetzt INPxC Eingang x Configuration Register BASE 0x0200 x 8 Bit Zugriff Name Default Beschreibung 63 16 RO 0 Reserviert 15 10 RW FSRATE 0 Sample Frequenz Eingangsfilter f...

Страница 27: ...ende Flanke des entsprechenden Ausgangs wieder Wenn ein Bit gesetzt wird wird STATUS IIF gesetzt Wenn das Bit gesetzt wird wird das entsprechende OUTPIF IF gesetzt Wenn das Bit mit 1 beschrieben wird wird das Bit zurückgesetzt OUTPIFF Output Interrupt Flag Register fallende Flanke BASE 0x0430 Bit Zugriff Name Default Beschreibung 31 0 RWC IFFEx 0 Jedes Bit spiegelt den Interruptzustand Fallende Fl...

Страница 28: ...g detektiert wird wird das entsprechende Bit in OUTPIFR IFRE gesetzt 1 RO 0 Reserviert 0 RW INV 0 Wenn 1 wird das Ausgangssignal invertiert bevor es weiter verarbeitet wird Ausgangsquellen Werte dezimal Ausgangssignal 0 OUTPx 1 1 2 DIO lesen 3 DIO schreiben 4 DIO Interrupt GSR IF 5 7 Reserviert 8 12 16 20 24 28 32 36 Counter x Overflow 9 13 17 21 25 29 33 37 Counter x Vergleich gleich CxSR CE 10 1...

Страница 29: ...ei Counter Overflow Wenn das Bit auf 1 gesetzt ist und CxSR OIF 1 wird CxSR IF gesetzt 1 RW IEN 0 Aktiviert einen Counter Interrupt Wenn das Bit auf 1 gesetzt ist und CxSR IF 1 wird ein Counter Interrupt ausgelöst 0 RW EN 0 Aktiviert den Counter Wenn das Bit auf 1 gesetzt ist ist der Zähler in Betrieb Wenn 0 wird der Zähler gestoppt und die Counter Register zurückgesetzt CxSR Counter x Status Regi...

Страница 30: ...rupt Flag für Counter Wenn OIF CEIF CGIF oder CSIF aktiviert wurden und aktiv sind wird das Flag gesetzt 0 RO 0 Reserviert CxVR Counter x Wert Register BASE 0x1010 x 0x100 Bit Zugriff Name Default Beschreibung 35 0 RO 0 Aktueller Zähler Wert CxTR0 Counter x Trigger Register 0 BASE 0x1020 x 0x100 Wenn der Trigger aktiv ist wird der Counter inkrementiert Bit Zugriff Name Default Beschreibung 31 24 R...

Страница 31: ...t wird der aktuelle Zählwert des Counters in das Capture Register CxCAPR geschrieben siehe Beschreibung CxTR0 Counter Trigger Quellen Wert dezimal Signal 0 0 1 1 2 DIO lesen 3 DIO schreiben 4 DIO Interrupt GSR IF 5 7 Reserviert 8 12 16 20 24 28 32 36 Counter x Overflow 9 13 17 21 25 29 33 37 Counter x Vergleich gleich CxSR CE 10 14 18 22 26 30 34 38 Counter x Vergleich größer CxSR CG 11 15 19 23 2...

Страница 32: ...iv ist wird der aktuelle Wert von CxVR in diesem Register gesichert Bit Zugriff Name Default Beschreibung 35 0 RW CAP 0 Capture Wert PCIEIS PCIe core Interrupt Status Register BASE 0x4040 Das Register enthält das Interrupt Statusbit des PCIe Kernel Bit Zugriff Name Default Beschreibung 31 8 RO Reserved 7 RO IA 0 Interrupt active Wenn dieses Bit gesetzt ist meldet der PCIe Kernel dem System einen I...

Страница 33: ...______________ ___________________ SIMATIC Industrial PCs SIMATIC PCIe DIO4 Compact Operating Instructions 11 2011 A5E03493449 01 Overview 1 Installing and connecting the DIO module 2 Technical specifications 3 Examples and register assignments 4 ...

Страница 34: ...he relevant documentation in particular its warning notices and safety instructions Qualified personnel are those who based on their training and experience are capable of identifying risks and avoiding potential hazards when working with these products systems Proper use of Siemens products Note the following WARNING Siemens products may only be used for the applications described in the catalog ...

Страница 35: ... 6 1 3 1 Input 7 1 3 2 Output 8 1 3 3 Counter 9 2 Installing and connecting the DIO module 11 2 1 Important installation note 11 2 2 Connecting the power supply of the outputs 11 3 Technical specifications 13 3 1 Terminal assignment 13 3 2 Technical specifications 14 4 Examples and register assignments 17 4 1 Initializing and enabling DIO 17 4 2 Examples 18 4 3 Registers 20 ...

Страница 36: ...Table of contents SIMATIC PCIe DIO4 4 Compact Operating Instructions 11 2011 A5E03493449 01 ...

Страница 37: ...vice and take precedence over statements in the operating instructions the release notes and the online help 1 2 Product description The DIO module is a PCIe x1 module and provides four digital 24 V inputs and four digital 24 V outputs The DIO module also offers eight hardware based counters 62 5 MHz base clock that can be configured for functions such as PWM frequency measurement and pulse width ...

Страница 38: ...d to counter states e g zero passage overflow 1 3 Design of the DIO module The DIO module consists of three main parts Input Output Counter QSXW 13 13 13 5 QYHUVLRQ QSXW ILOWHU GJH GHWHFWLRQ QSXW LQWHUUXSW UHJLVWHUV QSXW UHJLVWHU 13 13 QSXW FRQILJXUDWLRQ UHJLVWHU 2XWSXW LQWHUUXSW UHJLVWHUV 2XWSXW UHJLVWHU 2873 2873 2XWSXW FRQILJXUDWLRQ UHJLVWHU 2XWSXW GJH GHWHFWLRQ 6RXUFH VHOHFWLRQ QYHUVLRQ PRGH 2...

Страница 39: ...ng applies to the sample frequency fs 62 5 MHz INPxC FSRATE 12 Example Sample period of 1 ms INPxC FSRATE 0xF Sample threshold of 5 INPxC FTHRES 0x02 The input signal must have the same level for at least 5 ms until the input signal is passed through Input interrupts You can configure interrupts for rising falling or both edges of the input signal for each input INPxC ENREI enables an interrupt wi...

Страница 40: ...be implemented by selecting a different source Output interrupts You can configure interrupts for rising falling or both edges of the output signal for each output OUTPxC ENREI enables an interrupt with a rising edge OUTPxC ENREI enables an interrupt with a falling edge The following happens if one or both interrupts are enabled and an edge is detected The corresponding bits in OUTPIF OUTPIFR and ...

Страница 41: ...R includes the compare value 5 6 RPSDUH VHOHFWLRQ 205 RPSDUH UHJLVWHU RPSDUDWRU 65 65 65 6 65 2 DSWXUH UHJLVWHU 35 DSWXUH 75 RXQWHU UHJLVWHU 2YHUIORZ 95 8S RZQ OHDU 5HORDG 5HORDG UHJLVWHU 55 75 75 75 75 Counter The counter is a 36 bit counter operated with a cycle of 62 5 MHz With continuous incrementing the counter overflows after about 1099 5 seconds The overflow is signaled by setting CxSR OIF ...

Страница 42: ...Rx PRE Output mode CxTRx OMODE 6RXUFH VHOHFWLRQ HYHO KLJK HYHO ORZ GJH ULVLQJ GJH IDOOLQJ RWK HGJHV QSXW Q 7RJJOH PRGH 1RUPDO PRGH Q 2XW YHQW RXWSXW YHQW VRXUFHV HWHFW PRGH 3UHVFDOHU 2XWSXW PRGH Event effect Event Up CxTR0 The counter is incremented Event Down CxTR1 The counter is decremented Event Clear CxTR2 The counter is deleted 0 Event Reload CxTR3 The value from the CxRELR reload register is...

Страница 43: ... sure that the DIO module is installed with correct polarity digital inputs and outputs on outside If you do install the DIO module with reversed polarity and inadvertently take it into operation Remove the module and send it in for repair 2 2 Connecting the power supply of the outputs You need the supplied clamp on ferrite core from Würth order number 742711112 for the 24 V power supply cable NOT...

Страница 44: ... the power supply for the outputs with pin 10 P24V_EXT 3LQ 0B287 3LQ 3 9B 7 2 Connect the ground connector of the power supply for the outputs with pin 9 M_OUT 3 Route the 24 V power supply cable for the outputs through the open housing of the supplied clamp on ferrite core 4 Route the 24 V power supply cable once around the housing of the clamp on ferrite core 5 Close the clamp on ferrite core ho...

Страница 45: ...ions 3 3 1 Terminal assignment B287 B287 B287 B287 B 1 B 1 B 1 B 1 3LQ 287 3LQ 0B287 3LQ 287 3LQ 0B287 3LQ 287 3LQ 0B287 3LQ 287 3LQ 0B287 3LQ 3 9B 7 3LQ 0B287 3LQ 1 3LQ 0B 1 3LQ 1 3LQ 0B 1 3LQ 1 3LQ 0B 1 3LQ 1 3LQ 0B 1 0B 1 JDOYDQLFDOO LVRODWHG 0 1 0B287 0 1 RI RXWSXWV 3 9B 7 9 VXSSO IRU RXWSXWV ...

Страница 46: ...aratus does not meet the requirements of EN 61000 6 3 2007 Generic standards Emission standard for residential commercial and light industrial environments Noise immunity EN 61000 6 2 2005 Components for the overvoltage protection Cons no Cable for Component 1 Item no 1 Supply UN 24V DC BLITZDUCTOR VT BVT AD 24 918 402 2 Inputs of digital modules UN 24V DC DEHNconnect RK DCO RK ME 24 IL 0 5 A 919 ...

Страница 47: ...tatus display Orange LED per channel Control via logic not directly connected at input signal Digital outputs Number of outputs 4 Required connector 10 pin Weidmueller B2L 3 50 10 180 SN BK BX order no 1727660000 Cross section of connection cables at connector 0 08 mm2to 1 3 mm2 Outputs interruptible Yes on rising edge falling edge or both edges Integrated fuse Yes 3 15 A Isolation between channel...

Страница 48: ...tive load max 100 Hz max 0 5 Hz Load resistance range 48 Ω to 4 kΩ Outputs have a defined state After a reset Outputs are ZERO low With system standstill crash Outputs remain in last set state and can be reset with the device watchdog Counters Number of counters 8 Resolution 36 bit 16 ns Linking of inputs with counter Any Linking of outputs with counter Any Counter functions PWM pulse width freque...

Страница 49: ...e GSR 1 The INUSE flag prevents that several software components access the DIO at the same time Before a software accesses the DIO the software must check if the module in already in use by means of the INUSE flag The result of the INUSE bit must be 0 when the Global Status Register GSR is read for the first time All other read accesses must result in 1 The DIO is in use 4 Set the GCR EN The DIO ...

Страница 50: ...hanged at address OUTP1C BASE 0x500 1 8 BASE 0x508 Example 4 Triggering interrupt at input 0 with rising edge An interrupt is to be triggered with a rising edge at input 0 Enable the corresponding input interrupt and the global interrupts as follows Calculate the configuration address INP0C BASE 0x200 0 8 BASE 0x200 Enable the input interrupt with rising edge Set INP0C ENREI INP0C 0x04 Enable the ...

Страница 51: ...0x1000 3 0x100 BASE 0x1300 Programming event Up C3TR0 0x0100 Source 0x01 Always on Programming event Clear C3TR2 0x2B08 Source 0x2B input 3 0x08 rising edge Programming event Capture C3TR4 0x2B08 Source 0x2B input 3 0x08 rising edge Enabling C3 C3CR EN 1 The frequency is then calculated as follows f3 1 C3CAPR 1 16 ns Example 7 Measuring pulse length at input 2 In this example we use counter 1 C1 t...

Страница 52: ...ags Input Interrupt flags BASE 0x0120 32 RWC INPIFR Inputs 0 31 Interrupt flags rising edge BASE 0x0130 32 RWC INPIFF Inputs 0 31 Interrupt flags falling edge BASE 0x0200 64 RW INP0C Configuration of input 0 Filter inversion interrupt BASE 0x0208 64 RW INP1C Configuration of input 1 Filter inversion interrupt BASE 0x0210 64 RW INP2C Configuration of input 2 Filter inversion interrupt BASE 0x0218 6...

Страница 53: ... Up BASE 0x1028 32 RW C0TR1 Counter 0 Trigger Register 1 Down BASE 0x1030 32 RW C0TR2 Counter 0 Trigger Register 2 Clear BASE 0x1038 32 RW C0TR3 Counter 0 Trigger Register 3 Reload BASE 0x1040 32 RW C0TR4 Counter 0 Trigger Register 4 Capture BASE 0x1060 56 RW C0COMR Counter 0 Compare Register BASE 0x1070 56 RW C0RELR Counter 0 Reload Register BASE 0x1078 56 RW C0CAPR Counter 0 Capture Register Cou...

Страница 54: ...BASE 0x0000 Bit Access Name Default Description 31 RO 0 Reserved 30 26 RO NRCT 8 Number of counters timers 25 21 RO NROP 4 Number of output signals 20 16 RO NRIP 4 Number of input signals 15 8 RO REV 00 Revision 7 0 RO VER 10 Version of the DIO interface 1 0 GCR General Control Register BASE 0x0004 Bit Access Name Default Description 31 10 RO 0 Reserved 9 RW GATERST 0 If 1 the external reset is di...

Страница 55: ...bled counter interrupts are deleted the bit is reset 3 RO OIF 0 Output interrupt flag If this flag was set an output has triggered an interrupt If all enabled output interrupts are deleted the bit is reset 2 RO IIF 0 Input interrupt flag If this flag was set an input has triggered an interrupt If all enabled input interrupts are deleted the bit is reset 1 RO IF 0 Interrupt flag If EIF CIF OIF or I...

Страница 56: ...ption 31 0 RWC IFFEx 0 Each bit reflects the interrupt state of the falling edge of the corresponding input If the bit is set the corresponding INPUTIF IF is set If the bit is written with 1 the bit is reset INPxC Input x configuration register BASE 0x0200 x 8 Bit Access Name Default Description 63 16 RO 0 Reserved 15 10 RW FSRATE 0 Sample frequency input filter fs 62 5 MHz FSRATE 12 9 8 RW FTHRES...

Страница 57: ... of the corresponding output If a bit is set STATUS IIF is set If the bit is set the corresponding OUTPIF IF is set If the bit is written with 1 the bit is reset OUTPIFF Output interrupt flag register falling edge BASE 0x0430 Bit Access Name Default Description 31 0 RWC IFFEx 0 Each bit reflects the interrupt state Falling edge of the corresponding output If the bit is set the corresponding OUTPIF...

Страница 58: ... RO 0 Reserved 0 RW INV 0 If 1 the output signal is inverted before it is processed further Output sources Values decimal Output signal 0 OUTPx 1 1 2 Reading DIO 3 Writing DIO 4 DIO Interrupt GSR IF 5 7 Reserved 8 12 16 20 24 28 32 36 Counter x Overflow 9 13 17 21 25 29 33 37 Counter x Comparison equal to CxSR CE 10 14 18 22 26 30 34 38 Counter x Comparison greater than CxSR CE 11 15 19 23 27 31 3...

Страница 59: ...s set 1 RW IEN 0 Enables a counter interrupt If the bit is set to 1 and CxSR IF 1 a counter interrupt is triggered 0 RW EN 0 Enables the counter If the bit is set to 1 the counter is in operation If 0 the counter is stopped and the counter registers are reset CxSR Counter x Status Register BASE 0x1008 x 0x100 Bit Access Name Default Description 31 11 RO 0 Reserved 10 RO CS 0 Flag for comparison re...

Страница 60: ... RO 0 Reserved CxVR Counter x Value Register BASE 0x1010 x 0x100 Bit Access Name Default Description 35 0 RO 0 Current counter value CxTR0 Counter x Trigger Register BASE 0x1020 x 0x100 If the trigger is active the counter is incremented Bit Access Name Default Description 31 24 RO 0 Reserved 23 16 RW PRE 0 Trigger pre divider Number of events until trigger is enabled 15 14 RO 0 Reserved 13 8 RW S...

Страница 61: ... counter value of the counter is written to the capture register CxCAPR see description CxTR0 Counter trigger sources Value decimal Signal 0 0 1 1 2 Reading DIO 3 Writing DIO 4 DIO Interrupt GSR IF 5 7 Reserved 8 12 16 20 24 28 32 36 Counter x Overflow 9 13 17 21 25 29 33 37 Counter x Comparison equal to CxSR CE 10 14 18 22 26 30 34 38 Counter x Comparison greater than CxSR CE 11 15 19 23 27 31 35...

Страница 62: ...capture trigger CxTR4 is enabled the current value of CxVR in saved in this register Bit Access Name Default Description 35 0 RW CAP 0 Capture value PCIEIS PCIe core Interrupt Status Register BASE 0x4040 The register includes the interrupt status bit of the PCIe kernel Bit Access Name Default Description 31 8 RO Reserved 7 RO IA 0 Interrupt active If this bit is set the PCIe kernel signals an inte...

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