CIRCUIT DIAGRAM
PCS 103 696
6-4
6-4
GND
OUT
SUP
V
CLOCK/TIMING CONTROLLER
(I/O PORT 2)
C P U
I/O PORT 8
VDD
VKK
PROGR MEMORY
(ROM)
48KX8 BIT
8 BIT
TIMER/COUNTER
16 BIT
TIMER/COUNTER
INTERRUPT
CONTROLLER
6 BIT A/D-
CONVERTER
I/O PORT 7
I/O PORT 9
I/O PORT 1
I/O PORT 0
I/O PORT 6
I/O PORT 4
I/O PORT 5
I/O PORT 3
DATA MEMORY
(RAM)
1024X8 BIT
PROGRAM
COUNTER
BIT
QUALITY
DIVIDER
AND
OSCILLATOR
FILTER
RECONSTRUCTION
(8th ORDER)
BANDPASS
ANTI-
ALIASING
FILTER
CLOCKED
COMPARATOR
REFERENCE
VOLTAGE
CLOCK
REGENERATION
AND SYNC
COSTAS LOOP
VARIABLE AND
FIXED DIVIDER
57 Khz
GENERATOR
DIFFERENTIAL
DECODER
BIPHASE
SYMBOL
DECODER
TEST LOGIC AND OUTPUT
SELECTOR SWITCH
VP1
7410 A13
7411 A14
7412 B13
7413 B14
7414 B7
7415 B7
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9468 D10
9469 B7
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9522 D2
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6409 F15
6410 D12
6411 D13
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6401 C15
6402 D15
6403 D14
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6405 G15
6406 F15
6407 G15
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-31V
+LED
I
J
K
L
M
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1
2
STEREO
TECHNO
IS
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4
5
6
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9
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15
16
17
A
B
C
D
E
F
G
H
I
J
K
L
M
A
B
C
D
E
F
G
H
AUX
+5.6V
OPTIMAL or JAZZ
PWM
DATA
GND D
SROn
ENABLE
JAZZ
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TP_PLAY
TAPE
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CLK
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Mute
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DATA
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SA3
STEREO
F2
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STR
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D
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