Circuit Diagrams and PWB Layouts
10.
DDR2 controller
1
8
750_602_100927.ep
s
100927
DDR2 controller
P02A
P02A
2010-06-16
2
2010-02-05
1
8
204 000 90
8
0
AV-PIP BROADCOM
DDR01_A11
DDR01_A12
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3
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S
0
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3
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3
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S
0
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S
0B
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S
1
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S
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S
B
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S
B
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3
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3
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3
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3
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3
_A0
8
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3
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3
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3
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3
_A12
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3
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3
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3
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3
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3
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3
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3
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S
0B
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S
1
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S
1B
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3
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S
B
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3
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S
B
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3
_WEB
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5
1
2
6
24,
3
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8
0R
3
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3
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3
E4
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8
E
3
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3
F1
3
E2
1
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2F1
3
E
8
3
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2
3
7
8
3
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D
E
3
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*
3
F1
8
E
3
4
A
B
3
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3
3
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3
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3
7
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2F11 E2
A
B
8
4
5
C
6
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FF11 E
3
C
D
3
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3
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1FB4
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+1V
8
FF11
FF12
1
%
3
F16
56R
*
3
F19
1
8
0R
4K7
1
%
DDR-VREF1
3
F10
1FA7
+1V
8
1FA6
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3
F20
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150R
1F00
3
104
3
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FF14
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3
1FA4
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470p
1
%
56R
3
F12
1
8
0R
3
F1
8
+1V
8
*
1
u
0
2F12
470p
2F1
3
4K7
1
%
1FA
8
3
F14
1FB1
1
%
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3
F17
56R 1
%
3
F15
REF EMC HOLE
1F10
REF EMC HOLE
1F12
J4
J5
AC1
AB2
AC2
AB1
B6
F
3
H1
K2
H4
K
3
G1
K4
K5
F2
G2
L5
G
3
L4
H5
E2
J
3
B
3
C
3
G4
G5
H
3
H2
E1
J2
B1
D2
E5
F5
F4
E
3
E4
D5
A
3
B4
A4
B2
C4
B5
C5
C2
W5
W4
W2
W
3
D4
A1
D
3
A2
U
3
AA2
V2
Y2
Y5
V4
Y4
V5
U2
AA
3
V
3
W1
AA5
U4
AA4
U5
R5
N5
M2
P2
T5
T4
Y1
Y
3
M4
R2
P1
T2
P5
R4
R
3
T
3
P4
N
3
M
3
M5
L2
N1
N4
L
3
7F10-1
BCM7206
S
DRAM
64 BIT DDR2
P
3
N2
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3
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3
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3
1
%
1
%
4K7
3
F11
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2F11
1
u
0
FF1
3
FF10
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S
1B
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3
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DDR2-DQ1
3
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S
0
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S
0B
DDR2-DQ
S
1
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3
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3
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3
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S
B
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3
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3
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3
-A12
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3
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3
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S
1B
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3
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3
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3
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3
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3
-A
8
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3
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S
0
DDR0-DQ
S
0B
DDR0-DQ
S
1
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DDR0-DQ
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DDR0-A6
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DDR0-CLKB
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S
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DDR01-ODT
DDR01-RA
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3
DDR01-BA0
DDR01-BA1
DDR01-A0
DDR01-A1
DDR01-A2
DDR01-A
3
DDR01-A7
DDR01-A
8
DDR01-A9