3.5-SBC-APL – Rev. 0.1
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// 35
Pin
Signal
Pin
Signal
1
WAKE#
2
+3.3V_S5
3
N.C.
4
GND
5
N.C.
6
+1.5V_S0
7
CLKREQ#
8
UIM-PWR
9
GND
10
UIM-DATA
11
PCIe_REFCLK-
12
UIM-CLK
13
PCIe
14
UIM-RST
15
GND
16
UIM-VPP
17
UIM-C8
18
GND
19
UIM-C4
20
W_DISABLE#
21
GND
22
PLTRST#
23
PCIe_RX-
24
+3.3V_S5
25
26
GND
27
GND
28
+1.5V_S0
29
GND
30
PU 3.3V(S5) (Optional:
SMB_CLK)
31
PCIe_TX-
32
PU 3.3V(S5) (Optional:
SMB_DAT)
33
34
GND
35
GND
36
USB_D-
37
GND
38
USB_D+
39
+3.3V_S5
40
GND
41
+3.3V_S5
42
PU 3.3V(S0)
43
GND
44
PU 3.3V(S0)
45
N.C.
46
PU 3.3V(S0)
47
N.C.
48
+1.5V_S0
49
N.C.
50
GND
51
N.C.
52
+3.3V_S5
7.12.
CMOS Internal (CMOS1/2)
Figure 22: CMOS1/CMOS2 Internal Connector
1
