JVC RX-D402B, Руководство по обслуживанию

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SHEET 11
DATA0
DATA1
DATA2
DATA3 DATA4 DATA5 DATA6 DATA7 DATA8 DATA9 DATA10 DATA11 DATA12 DATA13 DATA14 DATA15 DATA16 DATA17 DATA18 DATA19 DATA20 DATA21 DATA22 DATA23 DATA24 DATA25 DATA26 DATA27 DATA28 DATA29 DATA30 DATA31 ADDR10 ADDR9 ADDR8 ADDR7 ADDR6 ADDR5 ADDR4 ADDR3 ADDR2 ADDR1 ADDR0 WE
RAS
CAS
BA1
BA0
CS
DQM
DATA13 DATA12 DATA11 DATA10
DATA9 DATA8
DATA2 DATA3 DATA4 DATA5 DATA6 DATA7
WE
CAS RAS CS BA0 BA1 ADDR10 ADDR0 ADDR1 ADDR2 DATA16 DATA17 DATA18 DATA19 DATA20 DATA21 DATA22 DATA23 DQM DQM
DQM
SDRAM_CLK
ADDR9 ADDR8 ADDR7 ADDR6 ADDR5 ADDR4 ADDR3
DQM
DATA31 DATA30 DATA29 DATA28 DATA27 DATA26 DATA25 DATA24
SDRAM_CLK
BUF_OUT_Y7
BUF_OUT_Y6
BUF_OUT_Y5
BUF_OUT_Y4
BUF_OUT_Y3
BUF_OUT_Y2
BUF_OUT_Y1
BUF_OUT_Y0
BUF_OUT_CBCR7
BUF_OUT_CBCR6
BUF_OUT_CBCR5
BUF_OUT_CBCR4
BUF_OUT_CBCR3
BUF_OUT_CBCR2
BUF_OUT_CBCR1
BUF_OUT_CBCR0
BUF_OUT_CLK
BUF_OUT_VS
BUF_OUT_HS
_OUT_CBCR0
_OUT_CBCR1
_OUT_CBCR2
_OUT_CBCR3
_OUT_CBCR4
_OUT_CBCR5
_OUT_CBCR6
_OUT_CBCR7
_OUT_Y1
_OUT_Y2
_OUT_Y3
_OUT_Y4
_OUT_Y5
_OUT_Y6
_OUT_Y7
_OUT_HS
_OUT_VS
_OUT_CLK
_OUT_Y0
IC781
FLI2310-LF-CF
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32
33
34
35
36
37
38
39
40
41
42
43
44
45
46
47
48
49
50
51
52
53 54 55 56 57 58 59 60 61 62 63 64 65 66 67 68 69 70 71 72 73 74 75 76 77 78 79 80 81 82 83 84 85 86 87 88 89 90 91 92 93 94 95 96 97 98 99
100 101 102 103 104
105
106
107
108
109
110
111
112
113
114
115
116
117
118
119
120
121
122
123
124
125
126
127
128
129
130
131
132
133
134
135
136
137
138
139
140
141
142
143
144
145
146
1
47
148
149
150
151
152
153
154
155
156
157 158 159 160 161 162 163 164 165 166 167 168 169 170 171 172 173 174 175 176 177 178 179 180 181 182 183 184 185 186 187 188 189 190 191 192 193 194 195 196 197 198 199 200 201 202 203 204 205 206 207 208
3 3 3 4 3 5 3 6 3 7 3 8 3 9 4 0
4 7 4 8 4 9 5 0 5 1 5 2 5 3 5 4 5 5 5 6 5 7 5 8 5 9 6 0 6 1 6 2 6 3 6 4 6 5 6 6 6 7 6 8 6 9 7 0
3 2 3 1 3 0 2 9 2 8 2 7 2 6 2 5 2 4 2 3 2 2 2 1 2 0 1 9 1 8 1 7 1 6 1 5 1 4 1 3 1 2 1 1 1 0 9 8 7 6 5
7 1 7 2 7 3 7 4 7 5 7 6 7 7 7 8 7 9 8 0 8 1 8 2 3
4 1 4 2 4 3
4 4 4 5 4 6
C3826
0.1
C3827
0.1
C3828
0.1
C3829
0.1
C3835
0.1
R3826
0
C3836
0.1
C3837
0.1
C3811
0.1
C3812
0.1
C3813
0.1
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0.1
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0.1
C3816
0.1
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0.1
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0.1
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C3820
0.1
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0.1
C3822
0.1
C3823
0.1
C3824
0.1
C3825
0.1
0
.1
C3862
0.1
C3863
0.1
C3864 0.1 C3865
0.1
C3866
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0.1
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0.1
C3870
0.1
C3871
0.1
R3819
100
R3820 22
R3821 22
R3822 22
R3823 33
R A 7 8 4 2 2
1
2
3
4
8
7
6
5
R A 7 8 3 2 2
1
2
3
4
8
7
6
5
R A 7 8 2 2 2
1
2
3
4
8
7
6
5
R A 7 8 1 2 2
1
2
3
4
8
7
6
5
R3825
4.7k
R3824
x
TP802
TP803
TP804
TP805
H S
V S
C L K
C B C R 0
C B C R 1
C B C R 2
C B C R 3
C B C R 4
C B C R 5
C B C R 6
C B C R 7
Y 0
Y 1
Y 2
Y 3
Y 4
Y 5
Y 6
Y 7
TP806
R3817 100
R3816 100
R3818 100
R3815 10k
R3814 10k
R3813 10k
TP801
X781
NAX0394-001X
C3842
33p
C3841
33p
R3828
470k
R3827
1
k
C3801
47/6.3 C3802
47/6.3
B U F _ O U T _ Y 7
B U F _ O U T _ Y 6
B U F _ O U T _ Y 5
B U F _ O U T _ Y 4
B U F _ O U T _ Y 3
B U F _ O U T _ Y 2
B U F _ O U T _ Y 1
B U F _ O U T _ Y 0
B U F _ O U T _ C B C R 7
B U F _ O U T _ C B C R 6
B U F _ O U T _ C B C R 5
B U F _ O U T _ C B C R 4
B U F _ O U T _ C B C R 3
B U F _ O U T _ C B C R 2
B U F _ O U T _ C B C R 1
B U F _ O U T _ C B C R 0
B U F _ O U T _ C L K
B U F _ O U T _ V S
B U F _ O U T _ H S
K3801 K3802
K3803
K3804
K3805
C3834
0.1
C3833
0.1
C3832
0.1
C3831
0.1
C3830
0.1
R3861
470
C3803
2.2
C3804
2.2
C3807
2.2
C3806
2.2
C3805
2.2
B U S _ S W 2
H S Y N C 1 _ P O R T 1
V S Y N C 1 _ P O R T 1
F I E L D I D 1 _ P O R T 1
I N _ C L K 1 _ P O R T 1
H S Y N C 2 _ P O R T 1
V S Y N C 2 _ P O R T 1
F I E L D I D 2 _ P O R T 1
V D D 1 ( 3 . 3 )
V S S i o
I N _ C L K 2 _ P O R T 1
B / C b / D 1 _ 0
B / C b / D 1 _ 1
B / C b / D 1 _ 2
B / C b / D 1 _ 3
B / C b / D 1 _ 4
V D D c o r e 1 ( 1 . 8 )
V S S c o r e
B / C b / D 1 _ 5
B / C b / D 1 _ 6
B / C b / D 1 _ 7
R / C r / C b C r _ 0
R / C r / C b C r _ 1
R / C r / C b C r _ 2
R / C r / C b C r _ 3
R / C r / C b C r _ 4
R / C r / C b C r _ 5
R / C r / C b C r _ 6
R / C r / C b C r _ 7
G / Y / Y _ 0
V D D 2 ( 3 . 3 )
V S S i o
G / Y / Y _ 1
G / Y / Y _ 2
G / Y / Y _ 3
G / Y / Y _ 4
V D D c o r e 2 ( 1 . 8 )
V S S c o r e
G / Y / Y _ 5
G / Y / Y _ 6
G / Y / Y _ 7
I N _ S E L
T E S T
D E V _ A D D R 1
D E V _ A D D R 0
S C L K
S D A T A
R E S E T _ N
V D D 3 ( 3 . 3 )
V S S i o
S D R A M D 0
S D R A M D 1
S D R A M D 2
SDRAMD3 SDRAMD4 SDRAMD5 SDRAMD6 SDRAMD7 SDRAMD8 SDRAMD9 SDRAMD10 SDRAMD11 VDD4(3.3) SDRAMD13 SDRAMD14 SDRAMD15 VDDcore3(1.8) VSScore SDRAMD16 SDRAMD17 SDRAMD18 SDRAMD19 SDRAMD20 SDRAMD21 SDRAMD22 SDRAMD23 SDRAMD24 SDRAMD25 VDDcore4(1.8) VSScore SDRAMD26 SDRAMD27 SDRAMD28 SDRAMD29 SDRAMD30 SDRAMD31 VDD5(3.3) VSSio TESTIN SDRAMADDR10 SDRAMADDR9 SDRAMADDR8 SDRAMADDR7 SDRAMADDR6 SDRAMADDR5 SDRAMADDR4 VDDcore5(1.8) VSScore SDRAMADDR3 SDRAMADDR2 SDRAMADDR1 SDRAMADDR0 SDRAMWE VSSio SDRAMD12
S D R A M R A S N
S D R A M C A S N
S D R A M B A 1
S D R A M B A 0
S D R A M C S N
S D R A M D Q M
S D R A M C L K O U T
V D D 6 ( 3 . 3 )
V S S i o
S D R A M C L K I N
T E S T 3
T E S T O U T 0
T E S T O U T 1
C T L O U T 0
C T L O U T 1
C T L O U T 2
C T L O U T 3
C T L O U T 4
V D D c o r e 6 ( 1 . 8 )
V S S c o r e
C L K O U T
B / U / P b _ O U T _ 0
B / U / P b _ O U T _ 1
V D D 7 ( 3 . 3 )
V S S i o
B / U / P b _ O U T _ 2
B / U / P b _ O U T _ 3
B / U / P b _ O U T _ 4
B / U / P b _ O U T _ 5
B / U / P b _ O U T _ 6
B / U / P b _ O U T _ 7
R / Y / P r _ O U T _ 0
R / Y / P r _ O U T _ 1
V D D c o r e 7 ( 1 . 8 )
V S S c o r e
R / Y / P r _ O U T _ 2
R / Y / P r _ O U T _ 3
R / Y / P r _ O U T _ 4
R / Y / P r _ O U T _ 5
R / Y / P r _ O U T _ 6
R / Y / P r _ O U T _ 7
V D D 8 ( 3 . 3 )
V S S i o
G / Y / Y _ O U T _ 0
G / Y / Y _ O U T _ 1
G / Y / Y _ O U T _ 2
G / Y / Y _ O U T _ 3
G / Y / Y _ O U T _ 4
G / Y / Y _ O U T _ 5
G / Y / Y _ O U T _ 6
G / Y / Y _ O U T _ 7
O E
PLL_PVDD(1.8)
PLL_PVSS
AVSS_PLL_BE1
AVDD_PLL_BE1(1.8) AVDD_PLL_BE2(1.8)
AVSS_PLL_BE2 AVSS_PLL_SD1
AVDD_PLL_SD1(1.8)
AVDD_PLL_FE(1.8)
AVSS_PLL_FE
RVSS
RVDD(1.8)
RVSS
NC
RVDD(3.3)
RVSS
NC
RVDD(3.3)
RVSS
NC
RVDD(3.3)
RVSS
NC NC NC
RVSS
RVDD(3.3)
RVSS RVSS
RVDD(3.3) RVDD(3.3)
TEST0 TEST1 TEST2
XTALIN
XTALOUT
VDD9(3.3)
VSSio
IN_CLK_PORT2
D1_IN_0
VDDcore8(1.8)
VSScore D1_IN_1 D1_IN_2 D1_IN_3 D1_IN_4 D1_IN_5 D1_IN_6 D1_IN_7
FID_PORT2
VS_PORT2 HS_PORT2
DQ2 VSSQ DQ3 DQ4 VDDQ DQ5 DQ6 VSSQ DQ7 NC VDD DQM0 WE CAS RAS CS NC BA0 BA1 A10/AP A0 A1 A2 DQM2 VDD NC DQ16 VSSQ DQ17 DQ18 VDDQ DQ19 DQ20 VSSQ DQ21 DQ22 VDDQ DQ23 VDD
VSS
DQ24 VSSQ DQ25 DQ26 VDDQ DQ27 DQ28 VSSQ DQ29 DQ30 VDDQ DQ31
NC
VSS
DQM3
A3 A4 A5 A6 A7 A8 A9
CKE CLK
NC NC
DQM1
VSS
NC
DQ8
VDDQ
DQ9
DQ10 VSSQ DQ11 DQ12 VDDQ DQ13
t o H D M I _ T X
t o H D M I _ T X
1 3 . 5 M H z
*1 *1
*1
*1 *1
LVA10561
(SHEET 10)
(SHEET
10)
(SHEET
10)