Contents
viii
Figures
2−1
Block Diagram
2-2
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5−1
EVM Selection
5-3
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5−2
DSK-To-EVM Stackup Diagram
5-3
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6−1
Top Layer
6-4
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6−2
Internal Plane 1
6-5
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6−3
Internal Plane 2
6-5
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
6−4
Bottom Layer (Mirrored)
6-6
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Tables
2−1
Analog Input Pinout Description
2-3
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2−2
ADC Reference Voltage
2-3
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2−3
Jumper Settings
2-4
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3−1
Digital Signal Pinout Description
3-2
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4−1
Power Connector Pinout Description
4-1
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