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User Man
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©
Nat
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al
Inst
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me
nt
s
|
B-
5
Table B-6.
TP2 Connector Pinout for the System Timing Slot
Pin
A
B
ab
C
D
cd
E
F
ef
1
PXIe_
PXIe_DSTARC0-
GND
PXIe_
PXIe_DSTARC8-
GND
PXIe_
PXIe_DSTARB8-
GND
2
PXIe_
PXIe_DSTARA0-
GND
PXIe_
PXIe_DSTARC9-
GND
PXIe_
PXIe_DSTARA8-
GND
3
PXIe_
PXIe_DSTARB0-
GND
PXIe_
PXIe_DSTARC1-
GND
PXIe_
PXIe_DSTARA9-
GND
4
PXIe_
PXIe_DSTARB1-
GND
PXI_STAR0
PXI_STAR1
GND
PXIe_
PXIe_DSTARB9-
GND
5
PXIe_
PXIe_DSTARA1-
GND
PXI_STAR2
PXI_STAR3
GND
PXIe_D
PXIe_DSTARC10-
GND
6
PXIe_
PXIe_DSTARC2-
GND
PXI_STAR4
PXI_STAR5
GND
PXIe_D
PXIe_DSTARA10-
GND
7
PXIe_
PXIe_DSTARB2-
GND
PXI_STAR6
PXI_STAR7
GND
PXIe_D
PXIe_DSTARB10-
GND
8
PXIe_
PXIe_DSTARA2-
GND
PXI_STAR8
PXI_STAR9
GND
PXIe_D
PXIe_DSTARC11-
GND
9
PXIe_
PXIe_DSTARC3-
GND
PXI_STAR10
PXI_STAR11
GND
PXIe_D
PXIe_DSTARA11-
GND
10
PXIe_
PXIe_DSTARB3-
GND
PXIe_D
PXIe_DSTARC16-
GND
PXIe_D
PXIe_DSTARB11-
GND
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