+1.8V_DDR
THE SYMBOL MARK OF THIS SCHEMETIC DIAGRAM INCORPORATES
SPECIAL FEATURES IMPORTANT FOR PROTECTION FROM X-RADIATION.
FILRE AND ELECTRICAL SHOCK HAZARDS, WHEN SERVICING IF IS
ESSENTIAL THAT ONLY MANUFATURES SPECFIED PARTS BE USED FOR
THE CRITICAL COMPONENTS IN THE SYMBOL MARK OF THE SCHEMETIC.
10uF
C329
10uF
C314
0.
1u
F
C340
0.
1u
F
C341
0.
1u
F
C338
0.
1u
F
C339
0.
1u
F
C337
BLM18PG121SN1D
L300
0.
1u
F
C342
0.1uF
C323
+1.8V_S_DDR
0.
1u
F
C308
0.
1u
F
C305
0.
1u
F
C332
0.
1u
F
C325
0.
1u
F
C310
0.
1u
F
C318
0.
1u
F
C313
0.
1u
F
C312
0.
1u
F
C331
0.
1u
F
C328
0.
1u
F
C327
0.
1u
F
C320
0.
1u
F
C330
0.
1u
F
C316
0.
1u
F
C306
0.
1u
F
C315
0.
1u
F
C317
0.
1u
F
C307
0.
1u
F
C334
0.1uF
C302
0.
1u
F
C304
0.
1u
F
C326
0.
1u
F
C319
0.
1u
F
C336
10uF
C324
10uF
C303
0.
1u
F
C345
56
R326
150
R344
OPT
56
R327
56
R338
0.1uF
C333
56
R334
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56
AR310
5
6
R308
56
R340
5
6
R309
56
R305
+1.8V_S_DDR
+1.8V_S_DDR
56
R342
1000pF
C335
56
R339
5
6
R317
OPT
R350
R347
OPT
56
R335
1K
1 %
R345
HYB18TC1G160C2F-2.5
IC300
J2
VREF
J8
CK
H2
VSSQ2
B7
UDQS
N8
A4
P8
A8
L1
BA2
L2
BA0
R8
NC3
K7
RAS
F8
VSSQ3
F3
LDM
P3
A9
M3
A1
N3
A5
K8
CK
R3
NC4
L3
BA1
J7
VSSDL
L7
CAS
F2
VSSQ4
B3
UDM
M2
A10/AP
K2
CKE
R7
NC5
M7
A2
N7
A6
M8
A0
J1
VDDL
K3
WE
E8
LDQS
P7
A11
K9
ODT
A2
NC1
N2
A3
P2
A7
H8
VSSQ1
F7
LDQS
A8
UDQS
R2
A12
L8
CS
E2
NC2
E7
VSSQ5
D8
VSSQ6
D2
VSSQ7
A7
VSSQ8
B8
VSSQ9
B2
VSSQ10
P9
VSS1
N1
VSS2
J3
VSS3
E3
VSS4
A3
VSS5
G9
VDDQ1
G7
VDDQ2
G3
VDDQ3
G1
VDDQ4
E9
VDDQ5
C9
VDDQ6
C7
VDDQ7
C3
VDDQ8
C1
VDDQ9
A9
VDDQ10
R1
VDD1
M9
VDD2
J9
VDD3
E1
VDD4
A1
VDD5
B9
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B1
DQ14
D9
DQ13
D1
DQ12
D3
DQ11
D7
DQ10
C2
DQ9
C8
DQ8
F9
DQ7
F1
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H9
DQ5
H1
DQ4
H3
DQ3
H7
DQ2
G2
DQ1
G8
DQ0
+1.8V_S_DDR
5
6
R304
2
2
R307
56
R319
0.
1u
F
C301
22
R330
56
R337
1K
1 %
R322
56
AR312
56
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5
6
R315
56
AR300
+1.8V_S_DDR
5
6
R316
56
AR301
R346
OPT
56
AR302
5
6
R313
5
6
R312
1000pF
C300
56
R332
56
AR303
1K1
%
R302
56
AR305
+1.8V_S_DDR
+1.8V_S_DDR
56
AR313
1K
1 %
R343
56
AR304
R329
OPT
0.
1u
F
C309
22
R306
56
AR306
22
R331
5
6
R303
R349
OPT
56
R325
5
6
R314
5
6
R318
56
AR308
5
6
R311
56
AR307
5
6
R310
56
R341
56
AR309
56
R320
1K
1 %
R301
1000pF
C311
+1.8V_S_DDR
150
R300
OPT
1K
1 %
R321
56
R328
0
R351
R348
OPT
+1.8V_S_DDR
IC100
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T26
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T25
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AF23
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T24
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AE23
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R26
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AD22
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R25
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AC22
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AD23
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R24
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AE22
B_DDR2_BA0
AC23
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AC24
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AB22
B_DDR2_MCLK
V25
/B_DDR2_MCLK
V24
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AB23
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U26
/B_DDR2_RAS
U25
/B_DDR2_CAS
U24
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AB24
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AB26
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AA26
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AC25
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AC26
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AB25
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AA25
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W25
B_DDR2_DQ1
AE26
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W24
B_DDR2_DQ3
AF24
B_DDR2_DQ4
AF25
B_DDR2_DQ5
V26
B_DDR2_DQ6
AE25
B_DDR2_DQ7
W26
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Y26
B_DDR2_DQ9
AD25
B_DDR2_DQ10
Y25
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AE24
B_DDR2_DQ12
AD26
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Y24
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AD24
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AA24
A_MVREF
D15
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C13
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A22
A_DDR2_A2
B13
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C22
A_DDR2_A4
A13
A_DDR2_A5
A23
A_DDR2_A6
C12
A_DDR2_A7
B23
A_DDR2_A8
B12
A_DDR2_A9
C23
A_DDR2_A10
B22
A_DDR2_A11
A12
A_DDR2_A12
A24
A_DDR2_BA0
C24
A_DDR2_BA1
B24
A_DDR2_BA2
D24
A_DDR2_MCLK
B14
/A_DDR2_MCLK
A14
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D23
A_DDR2_ODT
D14
/A_DDR2_RAS
D13
/A_DDR2_CAS
D12
/A_DDR2_WE
D22
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B18
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C17
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C18
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A19
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A18
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B17
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B15
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A21
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A15
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B21
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C21
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C14
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C20
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C15
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C16
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C19
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B16
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B20
A_DDR2_DQ12
A20
A_DDR2_DQ13
A16
A_DDR2_DQ14
B19
A_DDR2_DQ15
A17
HYB18TC512160B2F-2.5
IC301
J2
VREF
J8
CK
H2
VSSQ2
B7
UDQS
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A4
P8
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L1
NC4
L2
BA0
R8
NC3
K7
RAS
F8
VSSQ3
F3
LDM
P3
A9
M3
A1
N3
A5
K8
CK
R3
NC5
L3
BA1
J7
VSSDL
L7
CAS
F2
VSSQ4
B3
UDM
M2
A10/AP
K2
CKE
R7
NC6
M7
A2
N7
A6
M8
A0
J1
VDDL
K3
WE
E8
LDQS
P7
A11
K9
ODT
A2
NC1
N2
A3
P2
A7
H8
VSSQ1
F7
LDQS
A8
UDQS
R2
A12
L8
CS
E2
NC2
E7
VSSQ5
D8
VSSQ6
D2
VSSQ7
A7
VSSQ8
B8
VSSQ9
B2
VSSQ10
P9
VSS1
N1
VSS2
J3
VSS3
E3
VSS4
A3
VSS5
G9
VDDQ1
G7
VDDQ2
G3
VDDQ3
G1
VDDQ4
E9
VDDQ5
C9
VDDQ6
C7
VDDQ7
C3
VDDQ8
C1
VDDQ9
A9
VDDQ10
R1
VDD1
M9
VDD2
J9
VDD3
E1
VDD4
A1
VDD5
B9
DQ15
B1
DQ14
D9
DQ13
D1
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D3
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D7
DQ10
C2
DQ9
C8
DQ8
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F1
DQ6
H9
DQ5
H1
DQ4
H3
DQ3
H7
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G2
DQ1
G8
DQ0
TDDR_A[10]
/TDDR_MCLK
BDDR2_D[8]
BDDR2_A[0]
SDDR_D[7]
ADDR2_D[14]
SDDR_D[10]
TDDR_D[11]
TDDR_A[7]
ADDR2_A[8]
BDDR2_D[0-15]
TDDR_A[3]
BDDR2_MCLK
BDDR2_D[10]
BDDR2_A[12]
SDDR_D[15]
SDDR_A[0]
ADDR2_D[8]
TDDR_A[9]
TDDR_D[12]
BDDR2_A[7]
ADDR2_A[11]
SDDR_CK
TDDR_A[11]
ADDR2_A[0-12]
BDDR2_DQS0_P
BDDR2_D[13]
BDDR2_A[5]
SDDR_D[14]
SDDR_A[7]
ADDR2_D[9]
TDDR_A[6]
TDDR_D[10]
ADDR2_A[5]
ADDR2_A[6]
TDDR_A[4]
BDDR2_D[9]
BDDR2_A[10]
SDDR_D[13]
SDDR_A[12]
ADDR2_D[12]
/SDDR_CK
TDDR_A[0]
TDDR_D[8]
SDDR_A[5]
ADDR2_A[4]
SDDR_A[8]
BDDR2_D[14]
TDDR_MCLK
BDDR2_A[1]
SDDR_D[12]
SDDR_A[10]
ADDR2_D[7]
ADDR2_CKE
TDDR_A[7]
TDDR_D[3]
SDDR_A[9]
ADDR2_A[2]
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BDDR2_D[12]
BDDR2_A[3]
TDDR_CKE
SDDR_D[0]
SDDR_A[1]
ADDR2_D[6]
SDDR_CKE
TDDR_A[9]
TDDR_D[8]
ADDR2_A[0]
SDDR_A[6]
BDDR2_D[11]
BDDR2_A[9]
BDDR2_DQS0_N
SDDR_D[2]
SDDR_A[8]
ADDR2_D[4]
/ADDR2_MCLK
TDDR_A[8]
TDDR_D[1]
ADDR2_A[7]
SDDR_A[4]
BDDR2_D[13]
BDDR2_A[12]
BDDR2_ODT
SDDR_D[5]
SDDR_A[7]
ADDR2_D[5]
ADDR2_BA[2]
TDDR_A[0]
TDDR_D[9]
ADDR2_A[12]
SDDR_A[2]
BDDR2_D[9]
BDDR2_A[11]
BDDR2_DQS1_P
SDDR_D[13]
SDDR_A[6]
SDDR_BA[1]
ADDR2_D[2]
TDDR_A[10]
TDDR_D[4]
ADDR2_A[9]
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BDDR2_D[11]
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BDDR2_A[10]
BDDR2_DQM0_P
SDDR_D[0]
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TDDR_A[2]
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BDDR2_D[15]
ADDR2_D[0]
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SDDR_D[7]
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TDDR_D[12]
ADDR2_D[1]
TDDR_D[4]
TDDR_A[6]
TDDR_D[3]
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BDDR2_D[14]
ADDR2_DQS1_N
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SDDR_D[9]
SDDR_A[3]
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TDDR_D[14]
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TDDR_D[11]
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BDDR2_D[12]
ADDR2_DQS0_N
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BDDR2_A[7]
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SDDR_A[2]
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TDDR_D[15]
TDDR_A[5]
TDDR_D[5]
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/BDDR2_MCLK
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ADDR2_D[5]
BDDR2_A[6]
SDDR_D[15]
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TDDR_D[6]
TDDR_A[11]
TDDR_D[1]
ADDR2_A[11]
TDDR_DQM0_P
BDDR2_D[10]
ADDR2_DQM1_P
ADDR2_D[8]
BDDR2_A[5]
SDDR_D[14]
SDDR_A[0]
TDDR_D[9]
TDDR_A[3]
TDDR_D[6]
ADDR2_A[10]
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BDDR2_D[5]
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ADDR2_D[10]
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SDDR_D[4]
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TDDR_D[7]
TDDR_A[4]
TDDR_D[2]
ADDR2_A[8]
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BDDR2_D[7]
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ADDR2_DQS1_P
BDDR2_A[3]
SDDR_D[2]
SDDR_A[10]
TDDR_D[0]
TDDR_A[1]
ADDR2_A[9]
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BDDR2_D[4]
ADDR2_D[15]
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BDDR2_A[2]
SDDR_D[6]
SDDR_A[11]
TDDR_D[13]
ADDR2_A[4]
TDDR_DQS0_P
TDDR_BA[2]
BDDR2_D[6]
ADDR2_D[14]
/ADDR2_CAS
BDDR2_A[1]
SDDR_D[1]
SDDR_A[12]
TDDR_D[5]
ADDR2_A[6]
TDDR_DQS1_N
BDDR2_D[3]
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BDDR2_A[0]
SDDR_D[5]
TDDR_D[2]
ADDR2_A[7]
TDDR_D[0-15]
ADDR2_D[0-15]
TDDR_BA[0]
BDDR2_D[2]
ADDR2_D[6]
/ADDR2_RAS
SDDR_D[3]
TDDR_D[0]
ADDR2_A[5]
BDDR2_D[2]
/BDDR2_WE
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BDDR2_D[1]
ADDR2_D[1]
SDDR_DQS0_N
SDDR_D[4]
ADDR2_A[2]
BDDR2_D[0]
/BDDR2_CAS
/TDDR_WE
BDDR2_D[0]
ADDR2_D[3]
SDDR_DQS1_N
SDDR_D[9]
SDDR_ODT
ADDR2_A[3]
BDDR2_D[5]
/BDDR2_RAS
TDDR_BA[1]
ADDR2_D[4]
SDDR_DQM0_P
SDDR_D[1]
TDDR_A[0-12]
ADDR2_A[1]
BDDR2_D[7]
BDDR2_CKE
BDDR2_BA[2]
ADDR2_D[12]
SDDR_DQM1_P
SDDR_D[8]
TDDR_A[1]
ADDR2_A[0]
BDDR2_D[6]
BDDR2_A[8]
/TDDR_CAS
ADDR2_D[11]
SDDR_DQS0_P
SDDR_D[3]
TDDR_A[8]
BDDR2_D[1]
BDDR2_A[11]
BDDR2_DQM1_P
BDDR2_A[0-12]
ADDR2_D[13]
SDDR_DQS1_P
SDDR_D[8]
TDDR_A[5]
BDDR2_D[3]
BDDR2_A[6]
BDDR2_DQS1_N
ADDR2_MCLK
ADDR2_D[11]
/SDDR_WE
SDDR_D[10]
TDDR_A[2]
BDDR2_D[4]
TDDR_DQM1_P
BDDR2_A[4]
ADDR2_BA[1]
ADDR2_D[15]
/SDDR_CAS
SDDR_D[12]
TDDR_A[12]
BDDR2_D[15]
BDDR2_A[2]
SDDR_D[11]
ADDR2_BA[0]
ADDR2_D[10]
/SDDR_RAS
SDDR_D[11]
TDDR_D[15]
DDR2 1.8V By CAP - Place these Caps near Memory
DDR2
3 / 10
MSD3369GV Platform
08/12/19 (MP)
PI Result
Copyright © 2009 LG Electronics. Inc. All right reserved.
Only for training and service purposes
LGE Internal Use Only
