Lattice LatticeECP2, User Manual

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LatticeECP2 Standard Evaluation Board
Lattice Semiconductor User’s Guide
Figure 11. 64-Bit PCI, PCI-X
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1 1
D
D
C
C
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B
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A
VC
C
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3.
3V
PCI_ GNT _N
PCI_ TR DY _N
PCI_ DE VSEL_N
PCI_ AD0
PCI_ ACK64_N
PCI_ AD2
PCI_ RE Q64_N
PCI_ AD4
PCI_ AD6
PCI_ AD9
PCI_ AD11
PCI_ AD13
PC I_INTB _N
PC I_INTD_ N
PC I_INTA _N
PC I_INTC_ N
PCI_ PRSN T1 _N
PCI_ AD48
PCI_ PRSN T2 _N
PCI_ RS T_ N
PCI_ AD18
PCI_ AD20
PCI_ TM S
PCI_ AD22
PCI_ TD I
PCI_ AD24
PCIX_EC C3
PCI_ AD41
PCI_ AD63
PCI_ TD O
PCI_ AD54
VC
C
_
3.
3V
PC
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PCI_ AD49
PCIX_EC C4
PCI_ AD61
PCI_ AD39
PCI_ CB E7_N
PCI_ AD52
PCIX_EC C2
PCI_ AD59
PCI_ AD37
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PCI_ AD50
PCI_ CB E5_N
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C
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B
_
N
P
C
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INT
D
_
N
PCI_ AD57
PCI_ AD35
PCI_ AD46
PCI_ AD32
PCI_ CB E6_N
PCI_ CB E4_N
PCI_ AD55
PCI_ AD23
PCI_ AD33
PC I_P CIX CAP
PCI_ AD44
PCI_ AD53
PCI_ AD42
PCI_ TR STN
PCI_ AD51
PCI_ AD40
PCI_ AD62
PCI_ SMBC LK
PCI_ AD47
PCI_ AD38
PCI_ AD60
PCI_ SMBD AT
PCI_ AD45
PCI_ AD36
PCI_ AD58
PCI_ CB E3_N
PCI_ AD26
PCI_ AD28
PCI_ AD30
PCI_ M6 6EN
PCIX_EC C5
PCI_ AD16
PCI_ AD43
PCI_ AD15
PCI_ AD1
PCI_ AD3
PCI_ AD34
PCI_ CL K
PCI_ AD5
PCI_ AD7
PCI_ AD8
PCI_ AD10
PCI_ AD12
PCI_ AD14
PCI_ AD17
PCI_ AD19
PCI_ AD21
PCI_ AD25
PCI_ AD27
PCI_ AD29
PCI_ AD31
PCI_ TC K
PCI_ AD56
PC
I_
AD
[6
3:
0]
PCI_ STOP_N
PCI_ CB E0_N
PCI_ CB E1_N
PCI_ CB E2_N
PCI_ FR AME_N
PC I_IRDY _N
PCI_ RE Q_N
PC I_IDS EL
PCI_ SERR _N
PCI_ PERR _N
PCI_PAR
PC
I_
AD
31
PC
I_
AD
27
PC
I_
AD
29
PC
I_
AD
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AD
23
PC
I_
AD
30
PC
I_
AD
21
PC
I_
AD
19
PC
I_
AD
28
PC
I_
AD
26
PC
I_
AD
24
PC
I_
AD
22
PC
I_
AD
20
PC
I_
AD
17
PC
I_
AD
16
PC
I_
AD
18
PC
I_
AD
12
PC
I_
AD
14
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I_
AD
15
PC
I_
AD
7
PC
I_
AD
10
PC
I_
AD
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PC
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AD
5
PC
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AD
3
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AD
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AD
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AD
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AD
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AD
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AD
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I_
AD
60
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AD
58
PC
I_
AD
56
PC
I_
AD
50
PC
I_
AD
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I_
AD
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PC
I_
AD
51
PC
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AD
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AD
44
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AD
42
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AD
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I_
AD
32
PC
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AD
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PC
I_
AD
47
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AD
38
PC
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AD
43
PC
I_
AD
41
PC
I_
AD
37
PC
I_
AD
33
PC
I_
AD
35
PC
I_
AD
39
PC
I_
AD
2
PC
I_
AD
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AD
36
PC
I_
AD
46
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AD
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PC
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X
C
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Lattice Semiconductor Corporation
These 0.01 µF capacitors must be located within 0.25 inches of their PCI edge connector pin.
These 0.01 µF capacitors must be located within 0.25 inches of their PCI edge connector pin.
[5]
Load for Master Only
Load for Master Only
Load for Master Only
Load for Master Only
1-2 = Master 2-3 = 33 MHz PCI N/C = 66 MHz PCI
1-2 = 66MHz PCI-X N/C = 133 MHz PCI-X
1-2 = Target N/C = Master
[8]
1-2 = Master 2-3 = Target N/C = Target
1-2 = Master N/C = Target
Load for Master Only
Load for Master Only
Load for Master Only
Load for Master Only
PCI Decoupling
[8]
R5
1
5.
6K
R5
1
5.
6K
C1
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9
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1uF
CC0
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1uF
CC0
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C1
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1uF
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C1
1
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1uF
CC0
6
0
3
C5
1
0.
1uF
CC0
6
0
3
C5
1
0.
1uF
CC0
6
0
3
C5
2
0.
1uF
CC0
6
0
3
C5
2
0.
1uF
CC0
6
0
3
TP1 7 TP1 7 TP1 2 TP1 2
R8
8
10K R8
8
10K
(3 of 6)
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BANK4
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DQS Group
DQS Group DQS Group
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(3 of 6)
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BANK4
DQS Group DQS Group
DQS Group
DQS Group DQS Group
DQS Group
Pad Name = PB{12/22/35/50}
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3
C1
1
4
0.
1uF
CC0
6
0
3
J9J9
1 2 3
+
C9 10uF Si
z
e
B
+
C9 10uF Si
z
e
B
J2
3
HE
A
D
E
R
2
J2
3
HE
A
D
E
R
2 1 2
C1
0
0.
1uF
CC0
4
0
2
C1
0
0.
1uF
CC0
4
0
2
J3
8
J3 8
1 2 3
R1
0
6
5.
6K
R1
0
6
5.
6K
C1
0
7
0.
1uF
CC0
6
0
3
C1
0
7
0.
1uF
CC0
6
0
3
+
C1
2
10uF
Si
z
e
B
+
C1
2
10uF
Si
z
e
B
TP1 6 TP1 6
TP1 1 TP1 1
R1
0
7
5.
6K
R1
0
7
5.
6K
TP9 TP9
C6
1
0.
1uF
C
C
0402
C6
1
0.
1uF
C
C
0402
C1
0
8
0.
1uF
CC0
6
0
3
C1
0
8
0.
1uF
CC0
6
0
3
C4
2
0.
1uF
C
C
0603
C4
2
0.
1uF
C
C
0603
T
P14
T
P14
C
100
0.
1uF
CC0
6
0
3
C
100
0.
1uF
CC0
6
0
3
R1 5.
6K
R1 5.
6K
TP1 0 TP1 0
J1
9
H
EAD
ER
3X2
J1
9
H
EAD
ER
3X2
2 4 6
1 3 5
R5
9
5.
6K
R5
9
5.
6K
C9
0
0.
1uF
CC0
6
0
3
C9
0
0.
1uF
CC0
6
0
3
R6
2
5.
6K
R6
2
5.
6K
C3
0.
1uF
CC0
6
0
3
C3
0.
1uF
CC0
6
0
3
C1
1
0.
1uF
CC0
6
0
3
C1
1
0.
1uF
CC0
6
0
3
C1
1
3
0.
1uF
CC0
6
0
3
C1
1
3
0.
1uF
CC0
6
0
3
C4
7
0.
01uF
C
C
0603
C4
7
0.
01uF
C
C
0603
TP1 5 TP1 5
+
C4
5
10uF
Si
z
e
B
+
C4
5
10uF
Si
z
e
B
C9
9
0.
1uF
C
C
0402
C9
9
0.
1uF
C
C
0402
R1
2
6
5.
6K
R1
2
6
5.
6K
C6
0.
1uF
CC0
6
0
3
C6
0.
1uF
CC0
6
0
3
R6
0
5.
6K
R6
0
5.
6K
C3
9
0.
01uF
C
C
0603
C3
9
0.
01uF
C
C
0603
C5
0.
1uF
CC0
6
0
3
C5
0.
1uF
CC0
6
0
3
R6
1
5.
6K
R6
1
5.
6K
J4
8
P
C
I/P
CI-
X
6
4
b
it
E
D
G
E
CO
N B
o
tto
m
J4
8
P
C
I/P
CI-
X
6
4
b
it
E
D
G
E
CO
N B
o
tto
m
TRST #
1
+12 V
2
TMS
3
TDI
4
+5V _5
5
INTA#
6
INTC#
7
+5V _8
8
Rese rv ed _9
9
+VIO _1 0
10
Re se rved_11
11
3.3VAU X
14
RST#
15
+VIO _1 6
16
GNT #
17
Ground_18
18
PME#
19
AD[3 0]
20
+3.3 V_ 21
21
AD[2 8]
22
AD[2 6]
23
Ground_24
24
AD[2 4]
25
IDSE L
26
+3.3 V_ 27
27
AD[2 2]
28
AD[2 0]
29
Ground_30
30
AD[1 8]
31
AD[1 6]
32
+3.3 V_ 33
33
FR AME#
34
Ground_35
35
TRDY#
36
Ground_37
37
STOP#
38
+3.3 V_ 39
39
Re se rved_40
40
Re se rved_41
41
Ground_42
42
PAR
43
AD[1 5]
44
+3.3 V_ 45
45
AD[1 3]
46
AD[1 1]
47
Ground_48
48
AD[0 9]
49
C/BE #[0 ]
52
+3.3 V_ 53
53
AD[0 6]
54
AD[0 4]
55
Ground_56
56
AD[0 2]
57
AD[0 0]
58
+VIO _5 9
59
REQ 64 #
60
+5V _6 1
61
+5V _6 2
62
Ground_63
63
Ground_69
69
Ground_72
72
Ground_78
78
Ground_81
81
Ground_87
87
Ground_90
90
Ground_93
93
+VIO _6 6
66
+VIO _7 5
75
+VIO _8 4
84
Re se rved_92
92
Re se rved_94
94
C/BE [7]#
64
CB E[5] #/AD [4 8]
65
PAR6 4/EC C[7]
67
AD [48 ]/CB E[5 ]#
79
AD[6 2]
68
AD[6 0]
70
AD[5 8]
71
AD[5 6]
73
AD[5 4]
74
AD[5 2]
76
AD[5 0]
77
AD[4 6]
80
AD[4 4]
82
AD[4 2]
83
AD[4 0]
85
AD[3 8]
86
AD[3 6]
88
AD[3 4]
89
AD[3 2]
91
C8
0.
1uF
CC0
6
0
3
C8
0.
1uF
CC0
6
0
3
C5
0
0.
1uF
CC0
6
0
3
C5
0
0.
1uF
CC0
6
0
3
J1
3 HE
A
D
E
R
2
J1
3 HE
A
D
E
R
2 1 2
C5
8
0.
1uF
CC0
6
0
3
C5
8
0.
1uF
CC0
6
0
3
TP1 3 TP1 3
TP
8
TP 8
C9
2
0.
1uF
CC0
4
0
2
C9
2
0.
1uF
CC0
4
0
2
J1
4
PC
I/
PC
I-
X 64bi
t ED
GE C
O
N
T
o
p
J1
4
PC
I/
PC
I-
X 64bi
t ED
GE C
O
N
T
o
p
-12V
1
TCK
2
Ground_3
3
TDO
4
+5V _5
5
+5V _7
6
INTB#
7
INTD#
8
PRSN T1 #
9
Re se rved_10
10
PRSN T2 #
11
Re se rved_14
14
Ground_15
15
CLK
16
Ground_17
17
REQ #
18
+V IO_19
19
AD[3 1]
20
AD[2 9]
21
Ground_22
22
AD[2 7]
23
AD[2 5]
24
+3.3 V_ 25
25
C/BE #[3 ]
26
AD[2 3]
27
Ground_28
28
AD[2 1]
29
AD[1 9]
30
+3.3 V_ 31
31
AD[1 7]
32
C/BE #[2 ]
33
Ground_34
34
IRDY#
35
+3.3 V_ 36
36
DEV SE L#
37
Ground_38
38
LOCK #
39
PERR #
40
+3.3 V_ 41
41
SERR #
42
+3.3 V_ 43
43
C/BE #[1 ]
44
AD[1 4]
45
Ground_46
46
AD[1 2]
47
AD[1 0]
48
M66 EN
49
AD[0 8]
52
AD[0 7]
53
+3.3 V_ 54
54
AD[0 5]
55
AD[0 3]
56
Ground_57
57
AD[0 1]
58
+V IO_59
59
ACK64#
60
+5V _6 1
61
+5V _6 2
62
Re se rved_63
63
Ground_64
64
C/BE [6]#
65
CB E[4] #/AD [4 9]
66
Ground_67
67
AD[6 3]
68
AD[6 1]
69
+V IO_70
70
AD[5 9]
71
AD[5 7]
72
Ground_73
73
AD[5 5]
74
AD[5 3]
75
Ground_76
76
AD[5 1]
77
AD [49 ]/CB E[4 ]#
78
+V IO_79
79
AD[4 7]
80
AD[4 5]
81
Ground_85
85
Ground_82
82
+V IO_88
88
Ground_91
91
Ground_94
94
Re se rved_92
92
Re se rved_93
93
AD[4 3]
83
AD[4 1]
84
AD[3 9]
86
AD[3 7]
87
AD[3 5]
89
AD[3 3]
90
C6
0
0.
1uF
CC0
6
0
3
C6
0
0.
1uF
CC0
6
0
3 J2
4
H
EAD
ER
2
J2
4
H
EAD
ER
2
1 2