Contents
3
Contents
1
Introduction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5
1.1
Applications and Features . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 6
1.2
Block Diagram . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 9
2
Hardware Features . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 10
2.1
Carrier Board for Piggybacks . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 10
2.2
Synchronization Bus . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 10
2.3
Crankshaft Angle Clock Bus (CAC Bus) . . . . . . . . . . . . . . . . . . . . . . . . . . 11
2.4
Generating an Interrupt . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 15
2.5
Inspection and Versioning Data . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 16
3
CAN Interfaces (Optional) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 17
3.1
Features . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 18
3.2
Pin Assignment and Signals . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 19
4
Configuration. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20
4.1
Configuration of the Debug Port Connections of the Processor (JP0) . . . . 20
4.2
JTAG Chain Configuration (JP1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 21
4.3
Boot Configuration (SW0) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 22
4.4
Reset Switch (SW3) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 22
4.5
Addressing the ES1651.1 at the VMEbus (SW1 and SW2) . . . . . . . . . . . . 23
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