Bit 3 - Non utilisé.
Bit 2 - Erreur d'interrogation. Réglé en cas d'erreur d'interrogation. Le numéro d'erreur
approprié sera signalé dans le Query Error Register, comme indiqué ci-dessous.
1. Interrupted error (Erreur interrompue)
2. Deadlock error (Erreur de blocage fatal)
3. Unterminated error (Erreur non terminée)
Bit 1 - Non utilisé
Bit 0 - Opération terminée. Réglé en réponse à la commande *OPC.
Status Byte Register et Service Request Enable Register (Registre d'activation de
demande de service)
Ces deux registres sont mis en oeuvre comme exigé par la norme IEEE 488.2.
Tous les bits définis dans le Status Byte Register qui correspondent aux bits positionnés dans le
Service Request Enable Register entraîneront le positionnement du bit RQS/MSS dans le Status
Byte Register, ce qui génère une Service Request sur le bus.
Le Standard Event Status Register est lu, soit par la commande *STB?, qui renvoie MSS au bit 6
soit par une Serial Poll (scrutation série) qui renvoie RQS au bit 6. Service Request Enable
Register est réglé par la commande *SRE <nrf> et lu par la commande *SRE?.
Bit 7 - Non utilisé.
Bit 6 - RQS/MSS. Ce bit, défini par la norme IEEE 488.2, contient à la fois le message
Requesting Service et le message Master Status Summary (résumé d'état principal).
RQS est renvoyé en réponse à Serial Poll et MSS en réponse à la commande *STB?.
Bit 5 - ESB. Event Status Bit (bit d'état d'événement). Ce bit est réglé si des bits positionnés
dans le Standard Event Status Register correspondent aux bits réglés au Standard
Event Status Enable Register.
Bit 4 - MAV. Message Available Bit (bit de message disponible). Ce bit est réglé lorsqu'un
message de réponse de l'instrument est mis en forme et qu'il est prêt à être transmis au
contrôleur. Le bit sera réinitialisé lorsque le Response Message Terminator
(terminaison de message de réponse) a été transmis.
Bit 3 - Non utilisé.
Bit 2 - Non utilisé.
Bit 1 - Non utilisé.
Bit 0 - Non utilisé.
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