2-3
2-4
CD Diagram 1A
3
2
1
0
G4
3
0
1
0
4x
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VERSATILE
DEMOD
EFM
PLL
DIG.
STAGES
OUTPUT
CONTROL
MOTOR
KILL
INTERF.
LOOPBACK
SER. DATA
INTERF.
VERSAT.
INTERFACE
SER. DATA
BITSTREAM DAC
TIMING
INTERFACE
MICROCONTROLLER
PROCESSOR
AUDIO
PROCESSING
PRE-
FUNCTION
CONTROL
SRAM
ADDR
INTERF.
EBU
DET.
PEAK
CORR.
ERROR
PROCESSOR
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3
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5
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C
D
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RW
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VDD
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14
15
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9
10
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12
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B
A
B
C
D
E
E
F
G
H
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F308
F
G
6
7
8
9
10
11
12
15
FTC
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RF
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F305
F304
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2286
1n5
2285
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F324
F321
F319
F313
F314
100R
3274
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F180
F154
F160
F155
F146
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F147
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F165
F167
3279
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F183
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F178
F162
F164
F156
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F315
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3282
10K
10K
+5VHF
3270
10K
3269
+5VHF
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3275
100R
390p
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100R
+5VHF
+5VHF
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BC848B
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F177
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100R
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HFGND
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VPROC
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HFGND
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3265
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+5V
1M
3212
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+5VHF
+5VHF
+5VHF
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+5V
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HFGND
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HFGND
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47R
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GND
10
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33n
BF824
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3189
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VNEG
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VSSD3
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35
28
WCLK
47p
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36
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SELPLL
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43
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31
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44
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LN
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MOTO1
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MOTO2
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R2
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RA
41
RAB
RCK
45
38
RESETn
22
RN
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RP
48
SBSY
40
SCL
37
SCLI
29
SCLK
39
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9 D2
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11 D4
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51
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EF
FO
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2 HFIN
1 HFREF
6 IREF
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64
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18
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SAA7324
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HFGND
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HFGND
470n
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+3V3
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2154
47u
BFS20
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HFGND
HFGND
2166
47n
47R
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HFGND
HFGND
3202
22K
7011
BFS20
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100n
180p
2140
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47u
2151
+5VHF
1R
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390R
47u
2156
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3187
3191
430R
HFGND
CRIN
MUTE
EF
CFLG
V4
V4
FO
RA
SL
180R
3193
SCLK
CL11
MOT1
HFDET
DOBM5_CD
DOBM5_CD
S1
S2
RW
SILD
SCL
SDA
RESET
SCLK_IN
DATA_IN
WCLK_IN
CL16
DATA
WCLK
CD MAIN BOARD - CIRCUIT DIAGRAM 1A
DECODER & SERVO PROCESSOR PART
>800mVpp
eyepattern
2.5V
0,5us/DIV
3
eyepattern
2.5V
0,5us/DIV
1
2
5
4
6
PULSE DENSITY MODULATION
4
5
6
7
8.4672MHz
CD-DA, CD-R : 5V
CD-RW : 0V
8
1
2
9
9
10
11.2896MHz
CL 96532086_015.eps
080999
CONN. 1000 : TO CDM VAM1250
2.2 SCHEMATIC DIAGRAM
Summary of Contents for DR2100
Page 43: ......
Page 49: ...2 11 2 12 CD top CD MAIN BOARD TOP VIEW CL 96532086_019 eps 080999 2 3 PARTS LOCATION...
Page 52: ...2 17 2 5 ELECTRICAL PARTS LIST...
Page 53: ...2 18...