- 40 -
A
5
P_17
MD6
TP25
TP_T_C30
SCL_EX
RP1
100Rx4
1
2
3
4
8
7
6
5
MD22
VDDH3_3
RAS#
AD1
A
0
A
3
MCLK0#
AD5
C319
100nF
C3
100pF
M
P
U
h
a
s
D
a
t
a
/
A
d
d
r
e
s
s
m
u
l
t
i
p
l
e
x
Test pads for DDR
MD3
C311
100nF
0
1
MD24
R7
10K
MCLK0#
PWM
1
VDDH3_3
C313
100nF
P42LV6-T1 TV_Digital
C-03
SVP-EX 1 of 2
Qingdao Haier Electronics Co.,Ltd.
B
9
30
Monday, February 06, 2006
Title
Size
Document Number
Rev
Date:
Sheet
of
VDDH3_3
VDDMQ
M
A
0
MCLK0
MD19
MD14
R16
1K
FIELD
M
A
4
MVREF
C6
100nF
R15
10K_DNS
OUTPUT
M
A
3
MD27
TP2
TP_T_C30
I
2
C
A
d
d
r
e
s
s
:
7
E
/
7
F
M
A
7
R2
4K7
TP3
TP_T_C30
MD0
BRT_CNTL
VDDMQ
MPUGPIO0
SDA_EX
I
2
C
A
d
d
r
e
s
s
:
7
C
/
7
D
N
o
t
P
o
p
u
l
a
t
e
d
1
M
A
1
1
MPUGPIO1
MD23
TP6
TP_T_C30
TP1
TP_T_C30
1
MD9
C316
100nF
INT#
A
7
A
4
R
P
4
3
1
0
0
R
x4
1
2
3
4
8
7
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5
C314
100nF
VDDM
MPUCS0N
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0
D
Q
S
3
MPUGPIO4
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C306
100nF
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Q1
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1
2
3
MD18
DQM3
R5
4K7
AD2
0
For EX52 to use
this table
A[0..7]
MD13
A
1
MPUGPIO0
R13
4K7
1
1
C317
100nF
1
5V-1_CPU
MD2
Connector for Amtel AT76C112 Video Output
*CS1N is not a input or output pin
CS1N=0: SVP-EX CPU access enabled
CS1N=1:SVP-EX CPU access disabled
DQM[0..3]
M
A
1
R4
0R_DNS
VCC
MD31
C318
100nF
M
A
5
M
A
8
C305
100nF
1
MD8
RD_EX
R6
10R
P_17
R3
0R_DNS
C307
100nF
0
A
2
P_17
WR
P_39
D
Q
S
2
0
MD11
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MD4
MD30
1
MPUCS0N
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R20
10K_DNS
0
VD3_3
DQM0
R21
1K
SVP-EX [256]
(1 of 2)
U1A
SVP-EX_256
73
75
76
78
84
86
88
90
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93
94
96
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104
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152
154
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183
79
97
159
177
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0
0
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5
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0
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144
145
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5
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1
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1
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2
1
1
1
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1
0
1
8
7
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3
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8
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13
12
15
16
14
203
202
201
200
197
196
195
194
216
217
218
219
220
18
17
9
8
9
9
1
5
7
1
5
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1
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6
1
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1
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0
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8
1
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2
0
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2
0
7
2
0
8
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0
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1
0
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1
1
2
1
2
2
1
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MD2
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MD4
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MD6
MD7
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MD10
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MD21
MD22
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MD24
MD25
MD26
MD27
MD28
MD29
MD30
MD31
DQM0
DQM1
DQM2
DQM3
D
Q
S
0
D
Q
S
1
D
Q
S
2
D
Q
S
3
M
A
1
1
M
A
1
0
M
A
9
M
A
8
M
A
7
M
A
6
M
A
5
M
A
4
M
A
3
M
A
2
M
A
1
M
A
0
M
C
K
0
M
C
K
0
#
C
S
0
#
C
S
1
#
R
A
S
#
C
A
S
#
M
V
R
E
F
WE#
CLKE
BA0
BA1
M
P
U
G
P
IO
0
M
P
U
G
P
IO
1
V
D
D
R
V
S
S
R
V
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V
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V
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V
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M
V
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M
V
S
S
M
V
S
S
M
V
S
S
M
V
D
D
M
V
S
S
M
RESET
TESTMODE
V5SF
SDA
SCL
A_D7
A_D6
A_D5
A_D4
A_D3
A_D2
A_D1
A_D0
RD#
WR#
ALE
MPUCS0N
INT#
FLD/IO
P_17
V
S
S
M
V
D
D
M
V
D
D
M
V
S
S
M
V
S
S
M
V
D
D
M
M
P
U
G
P
IO
2
M
P
U
G
P
IO
3
M
P
U
G
P
IO
4
N
C
A
D
D
R
0
A
D
D
R
1
A
D
D
R
2
A
D
D
R
3
A
D
D
R
4
A
D
D
R
5
A
D
D
R
6
A
D
D
R
7
MPUGPIO1
DQS[0..3]
M
A
9
AD6
MD10
R10
68R
WE#
AD7
MPUGPIO0
MD[0..31]
MD17
C308
100nF
GPIO
TP24
TP_T_C30
MPUGPIO1
1
DQS0
R17
0R
TP5
TP_T_C30
1
3V_SDA
AD4
MD20
MD12
C320
100nF
MPUCS0N
CLKE
DQM1
MD21
1
CAS#
MD5
CS0#
0
33RX4 TO 100RX4
D
Q
S
1
MD25
AD0
R12
10K
MD29
RST_SVP
MD15
R19
10K_DNS
C315
100nF
INPUT
ALE
3V_SCL
R18
10K
1
AD[0..7]
M
A
6
M
A
2
DQM2
MD28
C2
100nF
D
Q
S
0
RP2
100Rx4
1
2
3
4
8
7
6
5
AD3
MD0
C5
68pF
C312
100nF
CS
M
A
1
0
MD1
*CS1N
A
6
DQM0
R8
0R_DNS
1
MPUGPIO0
R1
1K5
E_PWM
MD16
R9
68R
+
C1
10uF/16V
MPUGPIO2
MCLK0
VDDMQ
MA[0..11]
1
BA1
C309
100nF
R
P
4
2
1
0
0
R
x4
1
2
3
4
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7
6
5
MD7
33RX4 TO 100RX4
SDA_EX
M
P
U
h
a
s
s
e
p
a
r
a
t
e
d
A
d
d
r
e
s
s
/
D
a
t
a
MPUGPIO3
1
TP4
TP_T_C30
C310
100nF
if not a test pad, an enlarged via
underneath the chip or exposed
trace. Possible DQS MCLK
exposed trace, DQ enlarged via
SCL_EX
MPUGPIO0
0
C4
68pF
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Page 23: ... 23 4 PSU INPUT OUTPUT PIN PDF 文件使用 pdfFactory Pro 试用版本创建 www fineprint com cn ...